PELOC : 動的再構成FPGA用自動配置配線ツール : フレキシブルプロセッサへの応用(設計手法とシステムソフトウェア)
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概要
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我々の研究グループでは動的再構成FPGA用の自動配置配線ツール(PELOC : Processing Element Locator)を開発し、Visual C++を用いてGUI上に実装した。PELOCは、普通のFPGAの自動配置配線機能に加えて、動的再構成FPGA用に本研究独自の時間的回路分割機能と、時分割された回路間の通信機能をサポートする。実際に我々の研究グループで設計した省回路構成情報量マルチコンテクストFPGA(フレキシブルプロセッサ)にPELOCを適用した結果、シングルコンテクストには搭載不可能な規模のターゲット回路を正しく自動配置配線できることを確認した。
- 社団法人電子情報通信学会の論文
- 2005-09-08
著者
-
大見 忠弘
東北大学未来科学技術共同研究センター
-
須川 成利
東北大学 大学院 工学研究科
-
大川 猛
(独)産業技術総合研究所情報技術研究部門
-
須川 成利
東北大学大学院工学研究科
-
森田 瑞穂
大阪大学大学院工学研究科
-
宮本 直人
東北大学未来科学技術共同研究センター
-
小谷 光司
東北大学大学院工学研究科電子工学専攻
-
小谷 光司
東北大学大学院工学研究科
-
大川 猛
東北大学大学院工学研究科
-
大川 猛
National Institute For Advanced Industrial Science And Technology (aist):information Technology Rese
-
Ohkawa Takeshi
Department Of Electronic Engineering Tohoku University
-
岩間 大介
東北大学大学院工学研究科
-
ヤマック アミール
東北大学大学院工学研究科
-
アシュファクザマン カーン
東北大学大学院工学研究科
-
関東 弘明
東北大学大学院工学研究科
-
大川 猛
National Institute For Advanced Industrial Science And Technology (aist) Information Technology Rese
-
宮本 直人
東北大学 未来科学技術共同研究センター
-
大川 猛
(株)トプスシステムズ
-
大川 猛
宇都宮大学大学院工学研究科情報システム科学専攻
-
大見 忠弘
東北大学未来科学共同センター
-
須川 成利
東北大学大学院 工学研究科
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