動的再構成FPGAに適したプログラマブルロジックエレメントの開発
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概要
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FPGA(Field programmable Gate Array)とは機能再構成ができるハードウェアのことである.ユーザーがFPGA内部のロジックエレメント(LE)と配線の回路構成情報(コンフィギュレーションデータ)を書き換えることにより、ターゲットアプリケーションに適したハードウェア構成を得ることができる動的再構成FPGAは通常のFPGAとは異なり、チップ上に複数のコンフィギュレーションメモリ(回路構成情報を格納するためのメモリ)プレーンを持つので、通常のFPGAと比べて数倍のメモリリソースが必要である.通常のFPGAで主に用いられるLEはLUT(Look-Up Table)ベースのものである.LUTは回路構成情報量が多く、動的再構成FPGAに搭載するとLUTのコンフィギュレーションメモリのリソースが急激に増加し、相対的にユーザーが使用できるロジック部分もが減少する.本論文では、本来は4入力だが、必要に応じて2つの独立した2入力論理関数として使用可能な構成を持つLEを提案する.このLEを用いた場合、論理合成するときに使用されるLEの数を低減し、LUTと比較して42%程度の回路構成情報を削減することができた.
- 社団法人電子情報通信学会の論文
- 2003-01-21
著者
-
大見 忠弘
東北大学未来科学技術共同研究センター
-
宮本 直人
東北大学未来科学技術共同研究センター
-
小谷 光司
東北大学大学院工学研究科電子工学専攻
-
小谷 光司
東北大学工学研究科
-
カルナン レオ
東北大学工学研究科技術社会システム
-
宮本 直人
東北大学工学研究科電子工学
-
大見 忠弘
東北大学未来科学共同センター
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