テスト圧縮効率化のためのテスト生成に関する一考察(テスト,デザインガイア2012-VLSI設計の新しい大地-)
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概要
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近年,VLSIの大規模化,複雑化にともない,テスト対象となる故障モデル数と故障数の増加により,テストパターン数が増大している.テスト品質を維持しながらテストパターン数を削減する方法として,テスト圧縮技術がある.本論文では,2重検出,ドントケア抽出,テストパターンの併合から構成される一連の技術を,圧縮バッファ中のテスト集合に適用する概念を用いた動的テスト圧縮法を提案する.また,ケアビット数が多いテストパターンで検出されると予想できる故障を,できるだけ早い段階でテスト生成するために,テスト生成影響範囲を用いた故障選択法を提案する.ISCAS'89ベンチマーク回路に,本提案手法を適用した結果,一部の小規模回路に対しては現時点で知られている最小のサイズよりも小さいテスト集合を得ることができた.
- 2012-11-19
著者
-
山崎 浩二
明治大学情報コミュニケーション学部
-
細川 利典
日本大学生産工学部
-
吉村 正義
九州大学大学院システム情報科学研究院
-
山崎 浩二
明治大学
-
楠山 友紀乃
日本大学大学院生産工学研究科
-
山崎 達也
日本大学大学院生産工学研究科
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