低Vth設計・低電圧動作によるCMOSデバイスの低消費電力化
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概要
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CMOSデバイスの低消費電力化がクローズアップされている。本報告では、回路サンプルとして0.35μmルール、電源電圧3.3V用に設計された32bit CLA加算器を用いて、低消費電力化と回路性能の確保を同時に実現する手法として、低Vth設計と低電圧動作の組み合わせによる手法を検討し、これが有望である事を明らかにする。具体的には、1.5V程度の低電圧動作をさせる場合、VthをVdの10%以下(例えば0.1V)に設定することによって、Tpdと消費電力のバランスのとれた低消費出力デバイスが実現できる。
- 社団法人電子情報通信学会の論文
- 1995-09-05
著者
-
杉井 寿博
(株)富士通研究所
-
籾山 陽一
富士通マイクロエレクトロニクス株式会社
-
杉井 寿博
富士通マイクロエレクトロニクス株式会社
-
杉井 寿博
富士通研究所
-
井上 淳樹
(株)富士通研究所
-
籾山 陽一
(株)富士通研究所
-
立岡 真人
(株)富士通研究所
-
籾山 陽一
富士通(株)
-
杉井 寿博
富士通
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