符号選択式Booth Encoderを用いた54×54bコンパクト乗算器
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概要
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符号選択式Booth Encoderを用いた54×54bコンパクト乗算器を開発した。Boothのアルゴリズムに改良を加えることにより、Booth Selectorの回路規模を半分に削減し、54×54b乗算器をわずか60,797Tr.、コア面積1.27mm^2で実現し、当社従来型乗算器と比較してトランジスタ数で24%、面積で21%の削減を達成した。動作速度は4.1nsで、従来方式と同程度の動作速度を確保しつつ、回路規模は世界最少である。また、26×26b乗算器に符号選択式Booth Encoderを適用しても同様に回路規模の削減が実現できる。
- 社団法人電子情報通信学会の論文
- 1997-04-24
著者
-
後藤 源助
富士通研究所
-
後藤 源助
株式会社富士通研究所
-
伊澤 哲夫
富士通(株)プロセス開発部
-
大江 良一
(株)富士通研究所システムlsi開発研究所
-
伊澤 哲夫
(株)富士通
-
伊澤 哲夫
富士通株式会社usli開発部
-
井上 淳樹
(株)富士通研究所
-
柏倉 正一郎
(株)富士通研究所
-
御手洗 伸
富士通株式会社
-
鶴 隆行
富士通株式会社
-
後藤 源助
(株)富士通研究所
-
後藤 源助
山形大学理工学研究科
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