3次元積層型浮動小数点乗算器の回路分割手法に関する研究(高速デジタルLSI回路技術,デザインガイア2011-VLSI設計の新しい大地-)
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概要
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近年,LSIの更なる性能向上の手段として3次元積層技術が注目されている.3次元積層技術を用いて演算回路を実装する場合,演算回路を回路分割手法に基づいていくつかのサブ回路に分割し,各サブ回路が一つの層に実装される.そのため,回路分割手法により演算回路の性能は大きく変化する.本研究では,クリティカルパスと回路規模に着目した浮動小数点乗算器のための回路分割手法を提案する.提案手法は,クリティカルパス中にTSVが挿入されることを可能な限り避けるため,仮数部乗算部のクリティカルパスと正規化処理部および丸め処理部を同一の層に配置する.シミュレーションによる評価の結果,提案手法を用いた3次元積層浮動小数点乗算器は2次元実装の場合と比較して,単精度で最大8%,倍精度で最大17%の高速化を達成した.
- 一般社団法人電子情報通信学会の論文
- 2011-11-21
著者
-
小林 広明
東北大学
-
小林 広明
東北大学サイバーサイエンスセンター
-
江川 隆輔
東北大学大学院情報科学研究科
-
後藤 源助
山形大学大学院理工学研究科情報科学専攻
-
後藤 源助
富士通研究所
-
後藤 源助
株式会社富士通研究所
-
小林 広明
東北大学サイバーサイエンスセンター|科学技術振興機構戦略的創造研究推進事業
-
多田 十兵衛
山形大学大学院理工学研究科
-
多田 十兵衛
山形大学理工学研究科
-
後藤 源助
山形大学理工学研究科
-
江川 隆輔
東北大学サイバーサイエンスセンター:jst Crest
-
多田 十兵衛
東北大学サイバーサイエンスセンター
-
川合 一茂
山形大学理工学研究科
-
江川 隆輔
東北大学サイバーサイエンスセンター
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