乗算器の回路規模縮小に関する研究(システムLSIの応用と要素技術,専用プロセッサ,プロセッサ,DSP,画像処理技術,及び一般)
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概要
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近年の半導体加工技術の著しい進歩および回路の大規模化に伴う静的消費電力増加を抑えることを目的とし、乗算回路の小規模化を試みる。本報告では、乗算回路を構成する部分積生成部、部分積削減部、および桁上げ吸収加算部における算術アルゴリズムと回路規模の削減効果の関係を評価する。
- 社団法人電子情報通信学会の論文
- 2006-10-19
著者
-
中村 維男
東北大学大学院情報科学研究科情報基礎科学専攻
-
鈴木 健一
東北工業大学
-
中村 維男
東北大学大学院情報科学研究科
-
江川 隆輔
東北大学大学院情報科学研究科
-
後藤 源助
山形大学大学院理工学研究科情報科学専攻
-
後藤 源助
富士通研究所
-
後藤 源助
株式会社富士通研究所
-
陳 俊中
東北大学大学院情報科学研究科
-
多田 十兵衛
山形大学工学部
-
鈴木 健一
東北大学大学院情報科学研究科
-
後藤 源助
山形大学工学部
-
エドウイン 陳俊中
東北大学大学院情報科学研究科
-
多田 十兵衛
山形大学大学院理工学研究科
-
多田 十兵衛
山形大学理工学研究科
-
後藤 源助
山形大学理工学研究科
-
多田 十兵衛
東北大学サイバーサイエンスセンター
-
中村 維男
東京工業大学
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