暗号VLSIプロセッサのための固有電力消費アーキテクチャ
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概要
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現在の暗号VLSIプロセッサは電力消費解析を行うことで,演算処理内容や暗号そのものを解読することが可能である.本論文では,暗号や演算処理内容にかかわらずつねに一定の電力消費パターンを発生させることで暗号解析を困難とする,暗号VLSIプロセッサのための固有電力消費アーキテクチャを提案する.本アーキテクチャは二線式ダイナミック回路網で実現し,どのような入力信号系列が与えられても演算終了時までに一定回数のスイッチングを発生させ,消費電力および電力消費パターンを一定にすることを特徴とする.また,提案する固有電力消費アーキテクチャを用いて,0.6μm設計ルールの64ビットDESのデータバスを設計した.HSPICEによるシミュレーションの結果,従来の一線式CMOSでの実装と比較して電力消費解析が困難になることが明らかとなり,暗号プロセッサ用のアーキテクチャとして優れていることが分かった.
- 社団法人情報処理学会の論文
- 2001-04-15
著者
-
松原 裕之
東北大学大学院情報科学研究科情報基礎科学専攻
-
渡邊 孝博
山口大学工学部知能情報システム工学科
-
中村 維男
東北大学大学院情報科学研究科情報基礎科学専攻
-
中村 維男
東北大学大学院情報科学研究科
-
渡邊 孝博
山口大学工学部
-
松原 裕之
福岡工業大学
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