1V 50MH_z 10.5mW 低消費電力 DSP コア
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概要
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0.25μmデュアルVtプロセスを用いて1V動作に適したセルライブラリ、SRAM/ROMマクロを準備し、16bit固定小数点DSPを試作した。電源電圧1V,50MHzにおいてPDCハーフレート音声CODECを従来技術のDSPより42%少ない10.5mWの低消費電力で実現した。このDSPにはSRA.Mにブースト電圧を供給するために変換効率が59%と高《かつ待機時電力が10PWと小さい内部昇圧電源を設け、また外部インターフェースとの接続のためクランプ機能をもち450psと高速な1Vから2.5Vへのレベルコンバーターを組み込んだ。デュアルvt回路により待機時のリーク電力は通常のCMOSと同等に抑えることができた。
- 1999-10-28
著者
-
笹川 隆平
(株)富士通研究所
-
濱湊 真
(株)富士通研究所
-
川嶋 将一郎
(株)富士通研究所
-
塩田 哲雄
(株)富士通研究所システムLSI開発研究所LSIテクノロジ研究部
-
川嶋 将一郎
富士通マイクロエレクトロニクス・システムマイクロ事業部
-
大江 良一
(株)富士通研究所システムlsi開発研究所
-
塩田 哲義
(株)富士通研究所
-
柴本 亘
(株)富士通研究所
-
土屋 篤
(株)富士通研究所システムlsi開発研究所
-
濱湊 真
株式会社富士通研究所 システムlsi開発研究所 先端システムlsi研究部
-
濱湊 真
(株)富士通研究所 システムlsi開発研究所
-
石原 輝雄
(株)富士通研究所 システムlsi開発研究所
-
笹川 隆平
(株)富士通研究所 システムlsi開発研究所
-
塩田 哲義
(株)富士通研究所 システムlsi開発研究所
-
福士功 塩田哲義
(株)富士通研究所システムlsi開発研究所
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