Impact of Drain Induced Barrier Lowering on Read Scheme in Silicon Nanocrystal Memory with Two-Bit-per-Cell Operation
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概要
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- 2004-09-15
著者
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Hiramoto Toshiro
Institute Of Industrial Science University Of Tokyo
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Hiramoto Toshiro
Institute Of Industrial Science The University Of Tokyo
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Hiramoto T
Univ. Tokyo
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Hiramoto Toshiro
The Authors Are With Institute Of Industrial Science The University Of Tokyo:the Author Is With Vlsi
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Hiramoto Toshiro
Vlsi Design And Education Center The University Of Tokyo:institute Of Industrial Science The Univers
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Hiramoto Toshiro
Inst. Of Industrial Science And Cinqie University Of Tokyo
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Hiramoto Toshiro
Vlsi Design And Education Center The University Of Tokyo
-
PARK Sangsu
Institute of Industrial Science, University of Tokyo
-
IM Hyunsik
Univ. of Dongguk, Dept. of Semiconductor Science
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KIM Ilgweon
Institute of Industrial Science, University of Tokyo
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Im Hyunsik
Univ. Of Dongguk Dept. Of Semiconductor Science
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Kim Ilgweon
Institute Of Industrial Science University Of Tokyo
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Park Sangsu
Institute Of Industrial Science University Of Tokyo
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HIRAMOTO Toshiro
Institute Industrial Science, The University of Tokyo
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