500MHzパイプラインバースト動作の4Mb CMOS SRAM (I) : チップアーキテクチャと内部SRAM部の設計
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概要
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0.25μm CMOSプロセスを用い, プリフェッチバースト及びソースリセット方式の開発により, 32b 500MHz転送4-1-1-1読み出し動作を実現した, CMOS超高速キャッシュSRAMについて報告する。
- 社団法人電子情報通信学会の論文
- 1997-03-06
著者
-
清水 俊行
Nec
-
中村 和之
NECシリコンシステム研究所
-
武田 晃一
NEC
-
豊島 秀雄
NEC
-
野田 研二
NEC
-
岸本 光司
Nec
-
中村 和之
九州工業大学マイクロ化総合技術センター
-
大窪 宏明
NEC ULSIデバイス開発研究所
-
内田 哲弥
NEC ULSIデバイス開発研究所
-
井谷 俊郎
NEC ULSIデバイス開発研究所
-
渡嘉敷 健
NEC ULSIデバイス開発研究所
-
渡嘉敷 健
Nec
-
渡嘉敷 健
Nec Ulsiデバイス開発研究所微細加工技術開発部
-
井谷 俊郎
Selete
-
井谷 俊郎
日本電気ULSIデバイス開発研究所
-
武田 晃一
NECシステムデバイス研究所
-
中村 和之
NEC Corporation
-
大窪 宏明
Nec
-
武田 晃一
NEC マイクロエレクトロニクス研究所
-
井谷 俊郎
Nec
-
武田 晃一
Necエレクトロニクスlsi基礎開発研究所
-
内田 哲弥
Nec
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