順序回路型LUTカスケードによる多出力論理関数の実現(FPGAとその応用及び一般)
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概要
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本稿では,順序回路型LUT(Look up Table)カスケードによる多出力論理関数の実現について述べる.LUTカスケードは,新しいプログラマプル・デバイス(PLD: Programmable Logic Device)であり,組合せ回路型と順序回路型の2種類が存在する.組合せ回路型と順序回路型は異なる利害得失を持ち,応用分野に応じて使い分けることができる.多出力論理関数を実現する場合,順序回路型LUTカスケードは,組合せ回路型に比べ,より柔軟に設計可能である.本稿では,順序回路型LUTカスケードのプロトタイプを0.35μm CMOSテクノロジで設計し,その性能評価を行った.MPU(Micro Processing Unit)を用いたソフトウェア実現との比較実験では,順序回路型LUTカスケードは, SH-1(同一周波数換算)上でのソフトウェア実現に比べ,77倍から229倍高速であり, PentiumIII(同一周波数換算)上でのソフトウェア実現に比べ,35倍から88倍高速であった.また,現在市販されている0.18μm CMOS テクノロジのFPGA(Field Programmable Gate Array)で実現したものに近い性能が得られた.
- 社団法人電子情報通信学会の論文
- 2004-01-16
著者
-
笹尾 勤
九州工業大学情報工学部
-
松浦 宗寛
九州工業大学情報工学部
-
中村 和之
九州工業大学マイクロ化総合技術センター
-
永山 忍
広島市立大学大学院情報科学研究科
-
井口 幸洋
明治大学理工学部情報科学化
-
中村 和之
九州工業大学
-
井口 幸洋
明治大学理工学部情報科学科
-
笹尾 勤
九州工業大学 情報工学部 マイクロ化総合技術センター
-
永山 忍
九州工業大学
-
シン キ
九州工業大学情報工学部電子情報工学科
-
松浦 宗寛
九州工業大学大学院情報工学府情報創成工学専攻
-
笹尾 勤
九州工業大学 大学院 情報工学府 情報創成工学専攻
-
松浦 宗寛
九州工業大学 大学院 情報工学府 情報創成工学専攻
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