FPGA実装に適した多項式近似に基づく数値計算回路(アプリケーション高速化,リコンフィギャラブルシステム,一般)
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概要
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本稿は,k+1回微分可能な関数のk次多項式近似に基づく数値計算回路の構成とその自動合成法を示す.本数値計算回路は,多項式の次数kを増加することによって実装に必要なメモリ量を削減できるが,その一方で,実装に必要な論理素子や乗算器の数が増加する.このトレードオフを考慮し,FPGA上で使用可能なハードウェアリソースの量に応じて最も効率の良い数値計算回路を得るために,本稿では,FPGA使用率という尺度を導入し,最適な次数kを求める.実験により以下を示す:FPGA上のすべてのハードウェアリソースを使えるとき,1)低精度(17ビット精度まで)では,線形近似が最も効率の良い実装をもたらす.2)高精度(18ビットから24ビット精度まで)では,二次多項式近似が最も効率の良い実装をもたらす.
- 社団法人電子情報通信学会の論文
- 2006-09-08
著者
-
笹尾 勤
九州工業大学情報工学部
-
永山 忍
広島市立大学大学院情報科学研究科
-
BUTLER Jon
海軍大学院大学
-
Butler Jon
海軍大学院大
-
Butler Jon
Naval Postgraduate School Ca Usa
-
笹尾 勤
九州工業大学 情報工学部 マイクロ化総合技術センター
-
笹尾 勤
九州工業大学情報工学部電子情報工学科
-
永山 忍
広島市立大学大学院 情報科学研究科 情報工学専攻
-
笹尾 勤
九州工業大学 大学院 情報工学府 情報創成工学専攻
-
永山 忍
広島市立大学大学院 情報科学研究科
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