笹尾 勤 | 九州工業大学 情報工学部 マイクロ化総合技術センター
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概要
関連著者
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笹尾 勤
九州工業大学 情報工学部 マイクロ化総合技術センター
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笹尾 勤
九州工業大学 大学院 情報工学府 情報創成工学専攻
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笹尾 勤
九州工業大学情報工学部
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松浦 宗寛
九州工業大学情報工学部
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松浦 宗寛
九州工業大学 大学院 情報工学府 情報創成工学専攻
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松浦 宗寛
九州工業大学大学院情報工学府情報創成工学専攻
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笹尾 勤
九州工業大学情報工学部電子情報工学科
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中原 啓貴
九州工業大学情報工学部
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井口 幸洋
明治大学理工学部情報科学科
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井口 幸洋
明治大学理工学部情報科学化
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永山 忍
広島市立大学大学院情報科学研究科
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松浦 宗寛
九州工業大学情報工学部電子情報工学科
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BUTLER Jon
海軍大学院大学
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Butler Jon
海軍大学院大
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Butler Jon
Naval Postgraduate School Ca Usa
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永山 忍
広島市立大学大学院 情報科学研究科 情報工学専攻
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伊勢野 総
明治大学理工学部
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永山 忍
広島市立大学大学院 情報科学研究科
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永山 忍
九州工業大学
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永安 伸也
九州工業大学大学院情報創成工学専攻
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神田 徳夫
徳山工業高等専門学校
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神田 徳夫
徳山工業高等専門学校情報電子工学科
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栗元 憲一
九州工業大学情報工学部電子情報工学科
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川村 嘉郁
ルネサステクノロジ
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村上 敦
九州工業大学 情報工学部 電子情報工学科
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梶原 誠司
九州工業大学情報工学部電子情報工学科
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レディ スダーカ
アイオワ大学 電気コンピュータ学科
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川村 嘉郁
株式会社ルネサステクノロジ
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梶原 誠司
九州工業大学:jst Crest
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井口 幸洋
明治大学 理工学部 情報科学科
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スダーカ M.レディ
アイオワ大学電気コンピュータ学科
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草野 将樹
九州工業大学情報工学部電子情報工学科
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梶原 誠司
九州工業大学
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レディ スダーカ
アイオワ大学
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鈴木 隆広
明治大学大学院理工学研究科
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デブナス デバトシュ
九州工業大学情報工学部電子情報工学科
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中原 啓貴
鹿児島大学
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中村 和之
九州工業大学マイクロ化総合技術センター
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ミシュチェンコ アラン
ポートランド州立大学電気計算機工学科
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中村 和之
九州工業大学
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ポメランツ イリス
School of Electrical and Computer Engineering, Purdue University
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鈴木 隆広
静岡大学理工学研究科
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ポメランツ イリス
アイオワ大学電気コンピュータ学科
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シン キ
九州工業大学情報工学部電子情報工学科
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ポメランツ イリス
School Of Electrical And Computer Engineering Purdue University
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覃 輝
九州工業大学情報工学部電子情報工学科
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郷司 隼人
九州工業大学 情報工学部
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田中 浩之
九州工業大学大学院情報工学研究科情報創成工学専攻
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青山 俊一
明治大学理工学部情報科学化
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東田 基樹
大阪大学・工学部
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岡村 康一郎
九州工業大学
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伊勢野 総
明治大学 理工学部 情報科学科
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泉原 史幸
九州工業大学情報工学部・電子情報工学科
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清水 敬介
九州工業大学情報工学部
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中村 高明
九州工業大学大学院情報工学府情報創成工学専攻
-
Btler Jon
Debt. Of Elec. And Comp. Eng. Naval Postgraduate School
-
和田 精二
九州工業大学情報工学部電子情報工学科
-
レデイ スダーカ
アイオワ大学電気コンピュータ学科
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福山 泰介
九州工業大学大学院情報工学研究院
-
鈴木 隆広
明治大学理工学部情報科学科
-
鈴木 隆広
明治大学 大学院 理工学研究科
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Butler Jon
Naval Postgraduate School
-
東田 基樹
大阪大学
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神田 徳夫
徳山高専・情報電子工学科
-
清水 敬介
九州工業大学 情報工学部
-
浜地 啓
九州工業大学情報工学部電子情報工学科
-
デバトシュ デブナス
九州工業大学情報工学部電子情報工学科
-
岡村 康一郎
九州工業大学情報工学部電子情報工学科
著作論文
- 並列ブランチング・プログラム・マシンを用いた順序回路の模擬について(ネットワークオンチップ,システムオンシリコンを支える設計技術)
- 不完全定義インデックス生成関数の変数最小化について(高位・論理合成,システムオンシリコンを支える設計技術)
- EVBDDを用いた数値計算回路の構成(演算手法,デザインガイア2006-VLSI設計の新しい大地を考える研究会)
- 二次近似法に基づくプログラマブル数値計算回路の構成とその合成法(FPGAとその応用及び一般)
- プログラマブル数値計算回路のアーキテクチャとその合成法(設計手法と高性能化)
- 算術分解を用いた基数変換回路の構成法(3)(再構成可能デバイス/キャリブレーション,システムオンシリコン設計技術並びにこれを活用したVLSI)
- LUTカスケードを用いたCAMエミュレータについて(再構成可能デバイス/キャリブレーション,システムオンシリコン設計技術並びにこれを活用したVLSI)
- 算術分解を用いた基数変換回路の構成法(3)(再構成可能デバイス/キャリブレーション,システムオンシリコン設計技術並びにこれを活用したVLSI)
- FPGA上に実現した二つの近似文字列マッチングアルゴリズムの比較(システム設計・高位論理設計,システムオンシリコンを支える設計技術)
- 書換え可能な二変数関数の数値計算回路について(リコンフィギャラブル応用,デザインガイア2008-VLSI設計の新しい大地)
- TK-2-2 メモリ構造をしたプログラム可能論理素子とその応用(TK-2. 北九州での知的クラスター創成事業(第1期)の概要と成果・課題と展望,大会委員会企画)
- TK-2-2 メモリ構造をしたプログラム可能論理素子とその応用(TK-2. 北九州での知的クラスター創成事業(第1期)の概要と成果・課題と展望,大会委員会企画)
- TK-2-2 メモリ構造をしたプログラム可能論理素子とその応用(TK-2. 北九州での知的クラスター創成事業(第1期)の概要と成果・課題と展望,大会委員会企画)
- TK-2-2 メモリ構造をしたプログラム可能論理素子とその応用(TK-2. 北九州での知的クラスター創成事業(第1期)の概要と成果・課題と展望,大会委員会企画)
- TK-2-2 メモリ構造をしたプログラム可能論理素子とその応用(TK-2. 北九州での知的クラスター創成事業(第1期)の概要と成果・課題と展望,大会委員会企画)
- TK-2-2 メモリ構造をしたプログラム可能論理素子とその応用(TK-2. 北九州での知的クラスター創成事業(第1期)の概要と成果・課題と展望,大会委員会企画)
- TK-2-2 メモリ構造をしたプログラム可能論理素子とその応用(TK-2. 北九州での知的クラスター創成事業(第1期)の概要と成果・課題と展望,大会委員会企画)
- ハイブリッド法を用いたアドレス生成関数の構成法と更新法について(FPGAの応用)
- ハイブリッド法を用いたアドレス生成関数の構成法と更新法について(FPGAの応用)
- ハイブリッド法を用いたアドレス生成関数の構成法と更新法について(FPGAの応用)
- ハイブリッド法を用いたアドレス生成関数の構成法と更新法について(FPGAの応用)
- 基数変換回路の構成法(4) : RNSの場合(符号化と演算,デザインガイア2007-VLSI設計の新しい大地を考える研究会)
- 決定グラフに基づく論理関数の評価のメモリパッキングを用いた高速化について(上流設計技術(2),システムオンシリコン設計技術並びにこれを活用したVLSI)
- 決定グラフに基づく論理関数の評価のメモリパッキングを用いた高速化について(上流設計技術(2),システムオンシリコン設計技術並びにこれを活用したVLSI)
- 並列ブランチング・プログラム・マシンを用いたパケット分類器について(アプリケーション2,FPGA応用及び一般)
- 並列ブランチング・プログラム・マシンを用いたパケット分類器について(アプリケーション2,FPGA応用及び一般)
- 並列ブランチング・プログラム・マシンを用いたパケット分類器について(アプリケーション2,FPGA応用及び一般)
- 多文字遷移を行うNFAに基づく正規表現マッチング回路について(カスタムプロセッシング)
- 算術分解を用いた基数変換回路の構成法(2)(演算手法,デザインガイア2006-VLSI設計の新しい大地を考える研究会)
- 先読みヘテロジニアスMDDマシンについて(デザインガイア2010 : VLSI設計の新しい大地)
- 並列ふるい法とMPUを用いたウイルス検出エンジンについて(セキュリティ応用,デザインガイア2009 VLSI設計の新しい大地)
- パス遅延故障におけるパス選択とテスト生成について
- パス遅延故障におけるパス選択とテスト生成について
- パス遅延故障におけるパス選択とテスト生成について
- パス遅延故障のテストにおけるパス選択手法について
- パス遅延故障のテストにおけるパス選択手法について
- 関数分解を用いたFPGAの設計法
- 関数分解を用いたFPGAの設計法
- 3アドレスQDDマシン用コードの最適アルゴリズムについて(アプリケーションとシミュレーション,デザインガイア2009 VLSI設計の新しい大地)
- レイル数に制限のあるLUTカスケードの論理合成法 : 多出力論理関数の直接実現
- レイル数に制限のあるLUTカスケードの論理合成法 : 多出力論理関数の直接実現
- レイル数に制限のあるLUTカスケードの論理合成法 : 多出力論理関数の直接実現
- 論理関数のBi-decompositionについて
- 順序回路型LUTカスケードによる多出力論理関数の実現(FPGAとその応用及び一般)
- 順序回路型LUTカスケードによる多出力論理関数の実現(FPGAとその応用及び一般)
- 順序回路型LUTカスケードによる多出力論理関数の実現(FPGAとその応用及び一般)
- FIRフィルタの算術分解を用いたLUTカスケードによる実現(デバイスアーキテクチャI)
- FIR フィルタの LUT カスケードによる実現について(論理設計-1, システムオンシリコン設計技術並びにこれを活用した VLSI)
- FIR フィルタの LUT カスケードによる実現について(論理設計-1, システムオンシリコン設計技術並びにこれを活用した VLSI)
- FIRフィルタのLUTカスケードによる実現について
- 多端子EXOR三分決定グラフを用いたAND-EXOR論理式の最小化法について
- FPGA実装に適した多項式近似に基づく数値計算回路(アプリケーション高速化,リコンフィギャラブルシステム,一般)
- 二次近似法に基づくプログラマブル数値計算回路の構成とその合成法
- 二次近似法に基づくプログラマブル数値計算回路の構成とその合成法
- 二次近似法に基づくプログラマブル数値計算回路の構成とその合成法(FPGAとその応用及び一般)
- 二次近似法に基づくプログラマブル数値計算回路の構成とその合成法(FPGAとその応用及び一般)
- 二次近似法に基づくプログラマブル数値計算回路の構成とその合成法(FPGAとその応用及び一般)
- LUTカスケードを用いたCAMエミュレータについて(再構成可能デバイス/キャリブレーション,システムオンシリコン設計技術並びにこれを活用したVLSI)
- ソフトエラーを回避するLUTカスケード・エミュレータについて(耐過度故障,SWoPP2006)
- 耐故障性を有するLUTカスケード・エミュレータについて(システムオンシリコン設計技術並びにこれを活用したVLSI)
- 耐故障性を有するLUTカスケード・エミュレータについて(システムオンシリコン設計技術並びにこれを活用したVLSI)
- LUTカスケード・エミュレータを用いた論理シミュレーションについて(VLSIの設計/検証/テスト及び一般(デザインガイア))
- LUTカスケード・エミュレータを用いた論理シミュレーションについて(VLSIの設計/検証/テスト及び一般(デザインガイア))
- LUTカスケード・エミュレータを用いた論理シミュレーションについて(VLSIの設計/検証/テスト及び一般(デザインガイア))
- LUTカスケード・エミュレータを用いた論理シミュレーションについて(VLSIの設計/検証/テスト及び一般(デザインガイア))
- LUTリングを用いた順序回路の合成アルゴリズムについて(アルゴリズム)(VLSIの設計/検証/テスト及び一般)(デザインガイア2004-VLSI設計の新しい大地を考える研究会)
- LUTリングを用いた順序回路の合成アルゴリズムについて(アルゴリズム)(VLSIの設計/検証/テスト及び一般)(デザインガイア2004-VLSI設計の新しい大地を考える研究会-)
- LUTリングを用いた順序回路の合成アルゴリズムについて(アルゴリズム)(VLSIの設計/検証/テスト及び一般)(デザインガイア2004-VLSI設計の新しい大地を考える研究会-)
- LUTリングを用いた順序回路の合成アルゴリズムについて(アルゴリズム)(VLSIの設計/検証/テスト及び一般)(デザインガイア2004-VLSI設計の新しい大地を考える研究会-)
- 順序回路方式LUTカスケードにおけるメモリパッキングについて(信号解析,アルゴリズム,回路設計)
- 順序回路方式LUTカスケードにおけるメモリパッキングについて(信号解析,アルゴリズム,回路設計)(デザインガイア2003 -VLSI設計の新しい大地を考える研究会-)
- 順序回路方式LUTカスケードにおけるメモリパッキングについて(信号解析,アルゴリズム,回路設計)(デザインガイア2003 -VLSI設計の新しい大地を考える研究会-)
- 順序回路方式LUTカスケードにおけるメモリパッキングについて(信号解析,アルゴリズム,回路設計)(デザインガイア2003 -VLSI設計の新しい大地を考える研究会-)
- 順序回路方式LUTカスケードにおけるメモリパッキングについて
- 算術分解を用いた基数変換回路の構成法(アーキテクチャ,SWoPP2006)
- Walsh 係数を計算するハードウェアについて(論理設計-1, システムオンシリコン設計技術並びにこれを活用した VLSI)
- Walsh 係数を計算するハードウェアについて(論理設計-1, システムオンシリコン設計技術並びにこれを活用した VLSI)
- Walsh 係数を計算するハードウェアについて
- ルックアップ・テーブル・リングを用いた128ビットキーをもつAES暗号化回路の設計(ハードウェアアルゴリズム, FRGAとその応用及び一般)
- ルックアップ・テーブル・リングを用いた128ビットキーをもつAES暗号化回路の設計(ハードウェアアルゴリズム, FRGAとその応用及び一般)
- ルックアップ・テーブル・リングを用いた128ビットキーをもつAES暗号化回路の設計(ハードウェアアルゴリズム, FRGAとその応用及び一般)
- Walsh変換を用いた半導体メモリの故障診断法
- Walsh変換を用いた半導体メモリの故障診断法
- Walsh変換を用いた半導体メモリの故障診断法
- 決定グラフに基づく論理関数の評価システム
- 入力の一部が不明である場合の論理関数のハードウェアを用いた評価法 (テストと設計検証論文特集)
- 決定図に基づくサイクルベース・シミュレーション・エンジン
- ヘテロジニアスMDDにおける平均パス長の最小化法について(信号解析,アルゴリズム,回路設計)
- ヘテロジニアスMDDにおける平均パス長の最小化法について(信号解析,アルゴリズム,回路設計)(デザインガイア2003 -VLSI設計の新しい大地を考える研究会-)
- ヘテロジニアスMDDにおける平均パス長の最小化法について(信号解析,アルゴリズム,回路設計)(デザインガイア2003 -VLSI設計の新しい大地を考える研究会-)
- ヘテロジニアスMDDにおける平均パス長の最小化法について(信号解析,アルゴリズム,回路設計)(デザインガイア2003 -VLSI設計の新しい大地を考える研究会-)
- ヘテロジニアスMDDにおける平均パス長の最小化法について
- ヘテロジニアスMDDを用いた論理関数の表現法
- 3段論理回路の設計法 : NAND一面型PLDを対象にして
- サイクルベース・シミュレーション・エンジンの一構成法
- サイクルベース・シミュレーション・エンジンの一構成法
- サイクルベース・シミュレーション・エンジンの一構成法
- 論理関数の遷移数に関する考察
- オートマトンの分割に基づく正規表現マッチング回路について(FPGA応用,FPGA応用及び一般)
- オートマトンの分割に基づく正規表現マッチング回路について(FPGA応用,FPGA応用及び一般)
- オートマトンの分割に基づく正規表現マッチング回路について(FPGA応用,FPGA応用及び一般)
- 疑似クロネッカー決定グラフに基づくAND-EXOR多段論理回路構成法
- 疑似クロネッカ決定グラフを用いたFPGA設計手法
- 疑似クロネッカ決定グラフを用いたFPGA設計手法
- 疑似クロネッカ決定グラフを用いたFPGA設計手法
- パラメータを用いた論理関数分解法
- パラメータを用いた論理関数分解法
- パラメータを用いた論理関数分解法
- 4IGUエミュレータとMPUを用いたウイルス検出エンジンについて(FPGA応用)
- 先読みヘテロジニアスMDDマシンについて
- PLAの並列分解について
- 多出力AND-EXOR論理式簡単化の一手法
- 対称関数を表現するESOPの簡単化法について
- EXBOUND:多出力AND-EXOR論理式最小化プログラム
- 論理関数のLP特徴ベクトルとその応用
- 下界定理を用いたAND-EXOR論理式の簡単化法
- LUTカスケードにおけるLUT数削減法
- LUTカスケードにおけるLUT数削減法
- LUTカスケードにおけるLUT数削減法
- 二線式論理を用いた正則三値論理関数の実現法
- LUTカスケード・エミュレータにおけるレール出力の符号化法について(VLSIの設計/検証/テスト及び一般(デザインガイア))
- LUTカスケード・エミュレータにおけるレール出力の符号化法について(VLSIの設計/検証/テスト及び一般(デザインガイア))
- LUTカスケード・エミュレータにおけるレール出力の符号化法について(VLSIの設計/検証/テスト及び一般(デザインガイア))
- LUTカスケード・エミュレータにおけるレール出力の符号化法について(VLSIの設計/検証/テスト及び一般(デザインガイア))
- LUTカスケードにおけるレール出力の符号化法について(アルゴリズム)(VLSIの設計/検証/テスト及び一般)(デザインガイア2004-VLSI設計の新しい大地を考える研究会)
- LUTカスケードにおけるレール出力の符号化法について(アルゴリズム)(VLSIの設計/検証/テスト及び一般)(デザインガイア2004-VLSI設計の新しい大地を考える研究会-)
- LUTカスケードにおけるレール出力の符号化法について(アルゴリズム)(VLSIの設計/検証/テスト及び一般)(デザインガイア2004-VLSI設計の新しい大地を考える研究会-)
- LUTカスケードにおけるレール出力の符号化法について(アルゴリズム)(VLSIの設計/検証/テスト及び一般)(デザインガイア2004-VLSI設計の新しい大地を考える研究会-)
- EXBOUND : 多出力AND-EXOR論理式最小化プログラム
- AND-EXOR最小論理式の積項数の上界について
- 論理関数の代表元を用いたP同値類上での高速ブーリアンマッチング法
- 索表によるAND-OR-EXOR論理式最小化の一手法
- GRMIN : 一般化リード・マラー論理式の簡単化プログラムについて
- 一般化リード・マラー論理式の最小化について
- 索表によるAND-OR-EXOR論理式最小化の一手法
- ヘテロジニアスMDD for ECFNマシンの消費電力遅延時間積に関する一考察(最適化技術・高信頼化技術,デザインガイア2011-VLSI設計の新しい大地-)
- 分割MTMDDs for CFマシンについて(再構成処理とリアルタイム処理,FPGA応用及び一般)
- 分割MTMDDs for CFマシンについて(再構成処理とリアルタイム処理,FPGA応用及び一般)
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- AND-EXOR最小論理式の性質について