算術分解を用いた基数変換回路の構成法(アーキテクチャ,SWoPP2006)
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概要
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デジタル信号処理用の算術演算回路などでは,基数が2以外の論理回路を用いて,高速かつコンパクトな回路を実現する場合がある.この場合,基数変換回路が必要であるが,一般には複雑な回路となる.本論文では,p進数を2進数に変換する基数変換回路の構成法を提案する.本構成法では,算術分解と呼ぶ新しい方法を用いる.また,FPGA(Field Programmable Gate Array)上に基数変改回路を実現したときのハードウェア量と性能の比較を行う.
- 2006-07-25
著者
-
松浦 宗寛
九州工業大学情報工学部
-
井口 幸洋
明治大学理工学部情報科学科
-
井口 幸洋
明治大学 理工学部 情報科学科
-
笹尾 勤
九州工業大学 情報工学部 マイクロ化総合技術センター
-
松浦 宗寛
九州工業大学大学院情報工学府情報創成工学専攻
-
笹尾 勤
九州工業大学 大学院 情報工学府 情報創成工学専攻
-
松浦 宗寛
九州工業大学 大学院 情報工学府 情報創成工学専攻
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