並列ブランチング・プログラム・マシンを用いた順序回路の模擬について(ネットワークオンチップ,システムオンシリコンを支える設計技術)
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概要
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順序回路を模擬するブランチング・プログラム・マシン(BM)を基本演算要素とし,BMを128台並列に並べたマシン(PBM128)を試作した.PBM128は128台のBMとそれらを接続するプログラマブル接続回路からなる.論理関数を4値の決定グラフで表現し,3アドレス方式4分岐命令で評価する.PBM128上に種々の多出力ベンチマーク関数を実現し,Intel社のCore2Duoと比較を行った.PBM128が必要とするメモリ量はCore2Duoの約4分の1であり,速度は21.4〜96.1倍であった.
- 2009-03-04
著者
-
中原 啓貴
九州工業大学情報工学部
-
笹尾 勤
九州工業大学情報工学部
-
松浦 宗寛
九州工業大学情報工学部
-
川村 嘉郁
ルネサステクノロジ
-
川村 嘉郁
株式会社ルネサステクノロジ
-
笹尾 勤
九州工業大学 情報工学部 マイクロ化総合技術センター
-
笹尾 勤
九州工業大学情報工学部電子情報工学科
-
松浦 宗寛
九州工業大学大学院情報工学府情報創成工学専攻
-
笹尾 勤
九州工業大学 大学院 情報工学府 情報創成工学専攻
-
松浦 宗寛
九州工業大学 大学院 情報工学府 情報創成工学専攻
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