並列インデックス生成器を用いたIPv6検索アーキテクチャに関して(FPGA回路, FPGA応用及び一般)
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概要
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インターネットの爆発的な普及により,ルータの消費電力が問題になっている一方で,トラフィックは増加し続けている.従って,高速かつ低消費電力なIP検索アーキテクチャが必要である.また, IPv4アドレスの枯渇により,次世代IPv6が急速に普及している.本論文では,メモリをベースにしたIPv6検索アーキテクチャを実現する.IPv6のプレフィックスを直接メモリで実現した場合,メモリ量が指数関数的に爆発していまい,実現できない.本論文では,並列インデックス生成器を用いてIPv6検索アーキテクチャを実現する.既存の手法との比較を行い,並列インデックス生成器が高速かつコンパクトであることを示す.
- 2013-01-09
著者
-
中原 啓貴
九州工業大学情報工学部
-
笹尾 勤
九州工業大学情報工学部電子情報工学科
-
中原 啓貴
鹿児島大学
-
笹尾 勤
九州工業大学 大学院 情報工学府 情報創成工学専攻
-
松浦 宗寛
九州工業大学 大学院 情報工学府 情報創成工学専攻
-
松浦 宗寛
九州工業大学情報工学部電子情報工学科
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