並列EVMDD(k)マシンを用いたパケット分類器に関して(FPGA応用,リコンフィギャラブルシステム,一般)
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概要
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決定グラフマシン(DDM: Decision Diagram Machine)は決定グラフを評価する専用命令を有するプロセッサであり,汎用プロセッサよりもアーキテクチャが単純である.DDMは条件分岐を専用命令で実行するので,特定のアプリケーションに対して汎用プロセッサよりも高速に処理できる.本論文では,パケット分類器を並列EVMDD(k)マシンを用いて実現する.パケット分類器をコンパクトに表現し,並列に高速処理するため,ルールの集合をサブルール分割し,各サブルールを直積法を用いてフィールド関数とルール関数に分解する.そして,各関数を表現するEVMDD(k)から生成したプログラムを並列EVMDD(k)で並列に処理する.並列EVMDD(k)マシンをFPGA上に実装し,Intel社のCore(k)(1.7GHz動作)と比較を行った.並列EVMDD(k)マシンは実行時間に関してCore i5よりも7.8〜40.1倍高速であり,メモリ量に関して1.9〜8.3分の1であった.
- 一般社団法人電子情報通信学会の論文
- 2013-09-11
著者
-
中原 啓貴
九州工業大学情報工学部
-
中原 啓貴
鹿児島大学
-
松浦 宗寛
九州工業大学 大学院 情報工学府 情報創成工学専攻
-
笹尾 勤
明治大学理工学部情報科学科
-
松浦 宗寛
九州工業大学情報工学部電子情報工学科
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