並列ブランチング・プログラム・マシンを用いたパケット分類器について(アプリケーション2,FPGA応用及び一般)
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概要
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ブランチング・プログラム・マシン(BM)とは2種類の命令(分岐命令と出力命令)を有するプロセッサであり,汎用プロセッサよりもアーキテクチャが単純である.BMは条件分岐を専用命令で実行するので,特定のアプリケーションに対して汎用プロセッサよりも高速に処理できる.本論文では,パケット分類器を並列ブランチング・プログラム・マシン(PBM)を用いて実現する.パケット分類器のルールの集合を分割し,複数のBMで並列に処理する.ルール数が与えられたとき,所定の性能を出すために必要なBMの台数を推定できることを示す.BMを32台用いたPBM32をFPGA上に実装し,Intel社のCore2Duo@1.2GHzと比較を行った結果,PBM32は最長実行時間に関してCore2Duoよりも8.1〜11.1倍高速であり,メモリ量に関して9.7〜436.2分の1であった.
- 2010-01-19
著者
-
中原 啓貴
九州工業大学情報工学部
-
笹尾 勤
九州工業大学情報工学部
-
松浦 宗寛
九州工業大学情報工学部
-
川村 嘉郁
ルネサステクノロジ
-
川村 嘉郁
株式会社ルネサステクノロジ
-
笹尾 勤
九州工業大学 情報工学部 マイクロ化総合技術センター
-
笹尾 勤
九州工業大学情報工学部電子情報工学科
-
松浦 宗寛
九州工業大学大学院情報工学府情報創成工学専攻
-
笹尾 勤
九州工業大学 大学院 情報工学府 情報創成工学専攻
-
松浦 宗寛
九州工業大学 大学院 情報工学府 情報創成工学専攻
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