レイル数に制限のあるLUTカスケードの論理合成法 : 多出力論理関数の直接実現
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概要
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多出力論理関数を実現するLUTカスケード回路の実現法について述べる.多出力関数の表現法として,幾つかの方法について述べ,それをOR分解する方法について示す.次に,レイル数(二つのセルの間の線数)に制限がある場合のカスケード回路の設計アルゴリズムを示す.これより,メモリ量の削減が可能であり,大規模かつ高速な回路の実現も可能となる.多数のベンチマーク関数に本手法を適用した結果を述べる.
- 社団法人電子情報通信学会の論文
- 2002-11-21
著者
-
笹尾 勤
九州工業大学情報工学部
-
ミシュチェンコ アラン
ポートランド州立大学電気計算機工学科
-
笹尾 勤
九州工業大学 情報工学部 マイクロ化総合技術センター
-
笹尾 勤
九州工業大学 大学院 情報工学府 情報創成工学専攻
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