ルックアップ・テーブル・リングを用いた128ビットキーをもつAES暗号化回路の設計(ハードウェアアルゴリズム, FRGAとその応用及び一般)
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概要
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128ビットのキーをもつAES暗号回路をルックアップ・テーブル・リングを用いて設計し、FPGA上に実装した結果を述べる。
- 2005-01-19
著者
-
井口 幸洋
明治大学理工学部情報科学化
-
井口 幸洋
明治大学理工学部情報科学科
-
笹尾 勤
九州工業大学 情報工学部 マイクロ化総合技術センター
-
覃 輝
九州工業大学情報工学部電子情報工学科
-
笹尾 勤
九州工業大学 大学院 情報工学府 情報創成工学専攻
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