動的タイム・ボローイングを可能にするクロッキング方式の適用手法の評価
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概要
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半導体プロセスの微細化に伴う回路遅延のばらつきの増加が,回路設計における大きな問題となりつつある.ばらつきが増大していくと,従来のワースト・ケースに基づいた設計手法は悲観的になりすぎる.そのため,ワースト・ケースより実際に近い遅延に基づいた動作を実現する手法が提案されている.我々は以前,動的なばらつき対策手法としてのタイミング・フォールト検出を,二相ラッチのクロッキング方式に組み合わせることによって実現される,動的タイム・ボローイングを可能にするクロッキング方式を提案した.本手法によって,動作時にステージ間で回路遅延を融通し,実効遅延に近い速度で動作させることが可能になる.本稿では,この方式の適用を自動で行うツールの構成法やアルゴリズムについて述べる.
- 2013-07-24
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