回路面積指向レジスタ・キャッシュの評価(集積回路とアーキテクチャの協創 : どう繋ぐ?どう使う?マルチコア)
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概要
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レジスタ・ファイルは,最近のスーパスカラ・プロセッサの構成要素のうち,もっとも高コストなものの1つとなっている.本稿では,我々が提案した,レジスタ・ファイルの回路面積の縮小を目的とする回路面積指向レジスタ・キャッシュの評価と議論を行う.既存のレジスタ・キャッシュは.通常のキャッシュと同様,アクセス・レイテンシの短縮とそれによるパイプライン段数の縮小を第一の目的としている.それに対し,回路面積指向レジスタ・キャッシュの第一の目的は,回路面積の縮小であって,アクセス・レイテンシの短縮を図らない.評価により,回路面積指向レジスタ・キャッシュでは,性能をほとんど落とすことなく,メイン・レジスタ・ファイルのポート数を4まで減らすことができ,その回路規模をおよそ1/9程度にすることができることを確かめた.
- 2008-05-06
著者
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