チップ間高速信号伝送用イコライズ技術
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概要
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LSIチップ間の信号伝送を極限まで高速化しようとすると, 伝送路中での信号の反射や高周波成分の減衰などによる波形の乱れが問題になる. このような波形の乱れを補償するのがequalization技術である. 本論文ではボード上の信号伝送のような伝送長が短いチップ間信号伝送に対して適用可能なequalization技術として提案されたPartial Response Detection(PRD)の原理を示し,応用例を紹介する.
- 社団法人電子情報通信学会の論文
- 1999-05-25
著者
-
田口 眞男
富士通株式会社第4システムlsi事業部
-
田口 眞男
Spansion Japan
-
田口 眞男
富士通株式会社 半導体第2事業本部
-
田村 泰孝
富士通研究所システムLSI開発研究所
-
後藤 公太郎
富士通研究所システムLSI開発研究所
-
斎藤 美寿
富士通研究所システムLSI開発研究所
-
張 子誠
富士通研究所システムLSI開発研究所
-
若山 繁俊
富士通研究所システムLSI開発研究所
-
小川 淳二
富士通研究所システムLSI開発研究所
-
加藤 好治
富士通VLSI株式会社
-
今村 健
富士通研究所システムLSI開発研究所
-
齋藤 美寿
株式会社富士通研究所
-
張子 誠
株式会社富士通研究所
-
張 子誠
株式会社富士通研究所
-
若山 繁俊
(株)富士通研究所
-
田村 泰孝
株式会社 富士通研究所
-
小川 淳二
株式会社 富士通研究所
-
後藤 公太郎
株式会社 富士通研究所
-
後藤 公太郎
富士通研究所
-
今村 健
富士通研究所先端システムlsi研究部
-
加藤 好治
富士通vlsi株式会社第2lsi開発部
-
齋藤 美寿
富士通研究所システムlsi開発研究所
-
田村 泰孝
富士通研究所
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