±60ps位相合わせ精度の高速DRAM用多位相出力デジタル制御DLL
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概要
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高速DRAM用の多位相出力可能なDLL(ADMP DLL)を提案し, シミュレーションにより動作確認をした. 論理ゲートから構成される2種類(粗調整用と微調整用)の遅延段を用いて, すべてデジタル処理で外部クロックとの位相合わせをする. 粗調整用の遅延段を複数回まわることで多位相出力を行う. 微調整用の遅延段を設けることで位相合わせの高精度化が可能となり, 位相合わせ精度は±60psとなった. 4位相出力モードで400MHz, 6位相出力モードで280MHzの動作確認ができた.
- 社団法人電子情報通信学会の論文
- 1997-07-24
著者
-
田口 眞男
富士通株式会社第4システムlsi事業部
-
田口 眞男
Spansion Japan
-
田口 眞男
富士通株式会社 半導体第2事業本部
-
若山 繁俊
富士通研究所システムLSI開発研究所
-
齋藤 美寿
株式会社富士通研究所
-
若山 繁俊
(株)富士通研究所
-
後藤 公太郎
(株)富士通研究所
-
斎藤 美寿
(株)富士通研究所
-
小川 淳二
(株)富士通研究所
-
田村 泰孝
(株)富士通研究所
-
岡島 義憲
富士通株式会社
-
田村 泰孝
株式会社 富士通研究所
-
小川 淳二
株式会社 富士通研究所
-
後藤 公太郎
株式会社 富士通研究所
-
齋藤 美寿
富士通研究所システムlsi開発研究所
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