リタイミングと冗長除去を用いた順序回路の簡単化
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概要
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論理回路に含まれる冗長な信号線は回路面積やテスト容易性に悪影響を与える.本研究では回路の冗長除去にリタイミングを用いた手法を提案する.本手法ではゲート数やフリップフロップ数を削減するために組合せ回路用のテスト生成を用いた冗長除去とリタイミングを適用する.リタイミングは2回行われるが,1つは組合せ回路的冗長に変換することを目的とし,他の1つはフリップフロップ数の削減を目的とする.リタイミングを行った後に組合せ回路用の冗長除去手法を適用すると順序回路的冗長として含まれている冗長の一部も除去できるため,簡単化に有効である.ベンチマーク回路に対する実験結果より本手法により多くの順序回路的冗長を含む冗長部分の除去が可能であることを示す.
- 一般社団法人情報処理学会の論文
- 1995-10-19
著者
-
樹下 行三
大阪大学大学院工学研究科応用物理専攻
-
梶原 誠司
大阪大学大学院工学研究科応用物理学専攻
-
樹下 行三
大阪学院大 情報
-
四柳 浩之
大阪大学大学院工学研究科応用物理学専攻
-
四柳 浩之
徳島大学大学院ソシオテクノサイエンス研究部
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