DRAMベースの加算機能メモリとその動き補償への応用
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概要
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メモリの大容量化、プロセッサの高速化にともなうフォンノイマン・ボトルネックを解消するために、機能メモリというアーキテクチャが提案されている。我々は、機能メモリの一種としてDRAMをベースにした加算機能メモリの設計・試作を行った。これは、DRAM18ビット毎に1つの演算回路を付加し、メモリ内部で並列演算動作を行えるようにしたものである。演算回路は加算機能を基本に構成され、他に減算、絶対値演算等が可能になっている。加算機能メモリの構成、シミュレーション結果、および試作チップの測定結果について述べる。また加算機能メモリを動き補償に応用した場合の回路規模、性能について述べる。
- 社団法人電子情報通信学会の論文
- 1998-10-15
著者
-
田丸 啓吉
京都大学 通信情報システム専攻
-
田丸 啓吉
京都大学情報学研究科
-
田丸 啓吉
京都大学大学院 情報学研究科 通信情報システム専攻
-
小林 和淑
京都工芸繊維大学工芸科学研究科
-
小林 和淑
京都大学大学院情報学研究科通信情報システム
-
田丸 啓吉
京大
-
小林 幸史
京都大学大学院工学研究科電子通信工学専攻
-
江口 真
京都大学大学院情報学研究科通信情報システム専攻
-
唐 忱
京都大学情報学研究科通信情報システム専攻
-
小林 幸史
京都大学情報学研究科通信情報システム専攻
-
唐 忱
京都大学大学院情報学研究科通信情報システム専攻
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