遅延比較器を用いた低コストなFPGAの速度・歩留まり向上手法(システムオンシリコン設計技術並びにこれを活用したVLSI)
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概要
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本稿では遅延比較器を用いた低コストなFPGAの速度および歩留まりの向上手法について述べる。ランダムばらつきが支配的な状況下では、FPGAの速度および歩留まり向上を実現するために,クリティカルパスを個別に再配線する.再配線候補の中から最も高速な経路知る必要があるが,従来のパス遅延による測定法では経路ごとに速度を調べる必要がある.回路規模とともに候補が増えるため,測定コストは非常に大きくなる。そこで経路の速度差を容易に比較可能な遅延比較器をCLBに組み込んで配線最適化を低コストで実現する。測定コストを求めるには,クリティカルパスの測定順序を指定する必要がある.CLBに遅延比較器を実装し測定するための複数の条件により,測定順序の指定はグラフの彩色問題にモデル化できる.測定のコストは極大単色集合を用いた彩色アルゴリズムの彩色数κに等しい.κの上限と下限を算出し,回路規模に依らず定数のオーダとなることを導いた.また実装のための時間はパス数nのオーダで探索が可能と分かった.実際に配置配線ツールを用いて,複数のベンチマーク回路に対して,パス遅延と遅延比較器による測定コストを求めた.パス遅延による測定コストが指数のオーダになるのに対し遅延比較器を用いると定数のオーダとなり低コストで測定可能なことが確認できた.
- 社団法人電子情報通信学会の論文
- 2008-02-29
著者
-
小林 和淑
京都大学情報学研究科
-
小野寺 秀俊
京都大学情報学研究科
-
小野寺 秀俊
京都大学大学院 情報学研究科 通信情報システム専攻
-
小林 和淑
京都工芸繊維大学工芸科学研究科
-
小野寺 秀俊
京都大学情報学研究科:jst Crest
-
小林 和淑
京都大学大学院情報学研究科通信情報システム
-
久米 洋平
京都大学大学院情報学研究科
-
杉原 有理
京都大学大学院情報学研究科
-
LAI Ngo
京都大学大学院情報学研究科
-
小林 和淑
京都工芸繊維大学大学院工芸科学研究科電子システム工学専攻:jst Crest
-
Cam Lai
京都大学大学院情報学研究科
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