アナログ回路設計方法の再利用率向上手法 : 設計制約とパラメータの確信度の保存と再利用
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概要
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アナログ回路の設計方法を熟練設計者の設計過程より保存し, これを再利用することで設計の効率化/自動化を図る技術について検討した.本技術の要点は, いかに再利用率の高い設計方法をいかに低いコストで保存するかである.提案手法では, 設計方法を, 1.設計手順という手続きな情報, 2.設計者が設計過程で注目した制約条件, 3.設計過程で用いられた数値に対する設計者の確信度, の三つで表現し, これらを設計過程より保存し再利用する.再利用過程では, 確信度の低いパラメータを変動させてすべての設計制約が満足されるように手順を繰り返し実行し, 解を探索する.CMOSのオペアンプを用いた実験より, 従来の設計手順のみを用いた記述方法に比べ, 設計方法の保存コストをさほど高めることなく再利用率を高めることができることを示した.
- 社団法人電子情報通信学会の論文
- 1998-03-25
著者
-
田丸 啓吉
京都大学情報学研究科
-
小野寺 秀俊
京都大学大学院 情報学研究科 通信情報システム専攻
-
田丸 啓吉
京都大学大学院 情報学研究科 通信情報システム専攻
-
森江 隆史
京都大学大学院工学研究科
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