ゲート毎の電源電圧変動を考慮した静的遅延解析法(システムオンシリコン設計技術並びにこれを活用したVLSI)
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概要
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電源線ノイズを考慮した静的遅延解析法について議論する.各論理ゲートごとに供給される電源電位が異なる場合に,効率的にゲート遅延計算が行なえる手法を考案した.入力波形の電位と論理ゲートに供給されている電源電位をそろえる手法を用いることで,変数が少ないゲート遅延モデルを利用することが出来るようになった.このとき,出力波形が変化しないように電位変換前後での電流比から容量を調整する.実験により,精度良く遅延計算が可能であることを確認した.
- 社団法人電子情報通信学会の論文
- 2004-03-04
著者
-
橋本 昌宜
大阪大学大学院情報科学研究科
-
小野寺 秀俊
京都大学大学院 情報学研究科 通信情報システム専攻
-
橋本 昌宜
京都大学大学院情報学研究科通信情報システム
-
山口 隼司
京都大学大学院情報学研究科
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