電源ノイズに注目した電源遮断法の実機評価(ポスター講演,学生・若手研究会)
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概要
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本稿では,電源遮断構造の電源ノイズへの影響について,65nmプロセスで試作したテストチップの測定とシミュレーションより評価した結果を報告する.特に電源遮断構造を持つ回路の基板電位固定法に着目し,電源遮断されている回路のウェル容量がデカップリング容量として働くかを調査した.測定結果より,ウェル容量はRC時定数が大きく,急峻な電圧降下を低減することはできないが,基板電位を固定して電源遮断を行うことで,遮断回路のウェル容量がデカップリング容量として働き,電源ノイズ低減に貢献することを実験的に明らかにした.
- 社団法人電子情報通信学会の論文
- 2010-12-09
著者
-
尾上 孝雄
大阪大学大学院情報科学研究科
-
橋本 昌宜
大阪大学大学院情報科学研究科
-
尾上 孝雄
大阪大学情報科学研究科
-
尾上 孝雄
大阪大学大学院情報科学研究科情報システム工学専攻
-
尾上 孝雄
京都大学 大学院 情報学研究科 通信情報システム専攻
-
Onoye Takao
Osaka University
-
Onoye T
Kyoto Univ. Kyoto‐shi Jpn
-
Onoye Takao
Faculty Of Engineering Osaka University
-
Onoye Takao
Department Of Communications And Computer Engineering Kyoto University
-
Onoye Takao
Graduate School Of Engineering Osaka University
-
Onoye Takao
Department Of Information Systems Engineering Graduate School Of Information Science And Technology
-
橋本 昌宜
大阪大学情報科学研究科情報システム工学専攻
-
橋本 昌宜
大阪大
-
橋本 昌宣
大阪大学情報科学研究科情報システム工学専攻
-
高井 康充
大阪大学情報科学研究科
-
橋本 昌宜
大阪大学情報科学研究科
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