静的遅延解析のための等価ゲート入力波形導出法 : VDSMプロセスに起因する波形歪みへの対応
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概要
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本論文ではタイミング解析における等価ゲート入力波形の求め方について述べる.一般的にゲート入力波形の形状は2つの基準電圧を通過する時刻差で表わし,信号到着時刻は電源電圧の50%点を通過する時刻としている.しかしこの手法ではクロストーク,抵抗性容量遮蔽効果,インダクタンスなどのVDSMプロセスにおいて発生する諸問題に対処することができない.そこで提案手法では50%点を通過する時刻に捕われずに等価波形を求めることで,ゲート負荷によるゲート出力波形の変化を考慮した等価的な入力波形を求める.等価入力波形には最小二乗法を改良した重み付き最小二乗法を用いる.提案手法をタイミング解析に用いることでより正確な遅延時間を見積もることが可能となる.
- 一般社団法人情報処理学会の論文
- 2003-01-28
著者
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