近似ワーストケースを用いた歩留まり最適化手法
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概要
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近年のプロセスの微細化により、プロセス変動が回路特性に与える影響が無視できなくなっている。そこで、歩留まりを向上させるように素子値を最適化する手法の必要性が増している。しかしそれには非常に多くの回路シミュレーションが必要である。本稿では、近似ワーストケースを用いることで必要な回路シミュレーションの回数を削減する手法を提案している。また、近似ワーストケースを用いた最適化の途中から特徴点のみを用いて最適化を行なうことにより更にシミュレーション回数を削減する手法も提案している。手法を二段演算増幅器の最適化に適用し手法の有効性を検証している。
- 1997-03-07
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