ビット並列ブロック並列方式による機能メモリ型並列プロセッサの設計
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概要
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機能メモリ型並列プロセッサ(Functional Memory type Parallel Processor:FMPP)は、メモリの持つ規則構造を並列プロセッサに応用したものである。FMPPには構造の違いから数種類のアーキテクチャが提案されているが、そのうちビット並列ブロック並列(Bit Parallel Block Parallel:BPBP)方式は、メモリを数ワードからなる小ブロックに分割し、そのブロックをそれぞれ1個のプロセッサとして動作させる方式である。この方式はそれぞれのブロック内のワードについて演算処理を行なうことができるため、高並列性を実現することができる。本稿では、このBPBP型FMPPの構造とレイアウト結果について、以前製作のBPBP型FMPPとの比較を含めて述べる。
- 社団法人電子情報通信学会の論文
- 1996-03-11
著者
-
小林 和淑
京都大学 情報学研究科
-
田丸 啓吉
京都大学 通信情報システム専攻
-
小林 和淑
京都工芸繊維大学工芸科学研究科
-
山岡 雅直
京都大学大学院工学研究科電子通信工学専攻
-
山岡 雅直
京都大学 工学部
-
小林 和淑
京都工芸繊維大学大学院工芸科学研究科電子システム工学専攻:jst Crest
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