組合せ回路のゲート遅延故障に対する高分解能テストの生成
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概要
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遅延故障のモデルとしてゲート遅延故障とパス遅延故障がある.これまで提案されているゲート遅延故障のテストは,大きなゲート遅延故障を検出することを目的としており,小さなゲート遅延故障を検出できない.そこで本稿では,回路の各ゲートに1単位遅延を仮定した組合せ回路のゲート遅延故障に対して,テスト可能性を高めた高分解能テストを提案しその生成法を述べる.本稿で提案するテストは,1単位の付加遅延をもつ単一ゲート遅延故障を他のゲートの遅延にかかわらず検出する高分解能テストである。
- 社団法人電子情報通信学会の論文
- 1995-03-27
著者
-
高橋 寛
愛媛大学大学院理工学研究科
-
高橋 寛
愛媛大学工学部情報工学科
-
高松 雄三
愛媛大学工学部情報工学科
-
高松 雄三
愛媛大学工学部
-
渡部 崇史
愛媛大学工学部
-
渡部 崇史
愛媛大学工学部情報工学科
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