組合せ回路および順序回路に対する診断用テスト圧縮法(LSIシステムの実装・モジュール化・インタフェース技術, テスト技術)
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概要
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近年, 論理回路のテストや故障診断におけるコスト削減が重要になってきている.テストや故障診断のコストは, 印加されるテストベクトル数に依存するため, テストベクトルを削減することが重要である.本稿では, 組合せ回路および順序回路に対して, 故障診断のためのテストベクトル数を削減するテスト圧縮法を提案する.ここでは, 与えられたテスト集合またはテスト系列に対して, 区別される故障ペア数を減少させることなく, テストベクトル数を削減する.故障ペア数は故障数の2乗に比例するため, 大規模回路においてそれは膨大な数となる.そこで提案法では発見的手法を用いて, 一度に取り扱う故障ペア数を減少させることによって, 大規模回路においてもテストベクトル削減を可能にする.提案法の有効性は, ISCASベンチマーク回路に対する実験の結果によって示される.
- 社団法人電子情報通信学会の論文
- 2005-09-01
著者
-
小林 真也
愛媛大学工学部
-
小林 真也
愛媛大学 工学部
-
小林 真也
愛媛大学大学院理工学研究科
-
高橋 寛
愛媛大学大学院理工学研究科
-
樋上 喜信
愛媛大学工学部情報工学科
-
SALUJA KEWAL
Department of Electrical and Computer Engineering, University of Wisconsin-Madison
-
高橋 寛
愛媛大学工学部情報工学科
-
高松 雄三
愛媛大学工学部情報工学科
-
高松 雄三
愛媛大学
-
樋上 喜信
愛媛大学大学院
-
高松 雄三
愛媛大学工学部
-
Saluja Kewal
Department Of Electrical And Computer Engineering University Of Wisconsin-madison
-
サルージャ ケーワルk.
Department Of Electrical And Computer Engineering University Of Wisconsin - Madison
-
Saluja Kewal
ウィスコンシン大学
-
Saluja Kewal
ウィスコンシン大学マディソン校
-
Saluja Kewal
Univ. Of Wisconsin-madison Dept. Of Electrical And Computer Engineering
-
Saluja Kewal
ウイスコンシン大学
-
Saluja Kewal
Department Of Electrical & Computer Engineering Uw-madison
-
Takahashi Hiroshi
The Authors Are With The Faculty Of Engineering Ehime University
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