高松 雄三 | 愛媛大学工学部情報工学科
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概要
関連著者
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高松 雄三
愛媛大学工学部情報工学科
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高松 雄三
愛媛大学工学部
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高橋 寛
愛媛大学大学院理工学研究科
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高橋 寛
愛媛大学工学部情報工学科
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高松 雄三
愛媛大学
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樋上 喜信
愛媛大学工学部情報工学科
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樋上 喜信
愛媛大学大学院
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Takahashi Hiroshi
The Authors Are With The Faculty Of Engineering Ehime University
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山崎 浩二
明治大学情報コミュニケーション学部
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山崎 浩二
明治大学
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柳田 宣広
愛媛大学工学部情報工学科
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柳田 宣広
愛媛大学工学部
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于 湘秋
愛媛大学工学部情報工学科
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干 湘秋
愛媛大学工学部情報工学科
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山本 幸大
愛媛大学大学院理工学研究科
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山本 幸大
愛媛大 大学院理工学研究科
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小林 真也
愛媛大学工学部
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小林 真也
愛媛大学 工学部
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小林 真也
愛媛大学大学院理工学研究科
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西山 隆広
愛媛大学大学院理工学研究科
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梶原 誠司
九州工業大学情報工学部電子情報工学科
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梶原 誠司
九州工業大学:jst Crest
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サルージャ ケーワルk.
Department Of Electrical And Computer Engineering University Of Wisconsin - Madison
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Saluja Kewal
ウィスコンシン大学
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Saluja Kewal
ウィスコンシン大学マディソン校
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Saluja Kewal
Univ. Of Wisconsin-madison Dept. Of Electrical And Computer Engineering
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渡部 崇史
愛媛大学工学部
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Saluja Kewal
ウイスコンシン大学
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渡部 崇史
愛媛大学工学部情報工学科
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梶原 誠司
九州工業大学
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佐藤 雄一
愛媛大学大学院理工学研究科
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山崎 浩二
明治大学理工学部情報科学科
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SALUJA KEWAL
Department of Electrical and Computer Engineering, University of Wisconsin-Madison
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武智 清
愛媛大学大学院理工学研究科情報工学専攻
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山田 輝彦
明治大学理工学部情報科学科
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塩坂 知子
愛媛大学大学院理工学研究科
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山田 輝彦
明治大学理工学部
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Saluja Kewal
Department Of Electrical And Computer Engineering University Of Wisconsin-madison
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綾野 秀和
愛媛大学大学院理工学研究科
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ボアテン クァメ
愛媛大学工学部情報工学科
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樹下 行三
大阪学院大 情報
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Saluja Kewal
Department Of Electrical & Computer Engineering Uw-madison
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村田 健史
愛媛大学総合情報メディアセンター
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木村 映善
愛媛大学総合情報メディアセンター
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市原 英行
広島市立大学情報科学部
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川原 稔
愛媛大学総合情報メディアセンター
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村田 健史
情報通信研究機構
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市原 英行
広島市立大学大学院情報科学研究科
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門山 周平
愛媛大学大学院
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山崎 亜佳根
愛媛大学大学院理工学研究科
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精山 哲也
愛媛大学大学院理工学研究科
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栗山 和樹
愛媛大学大学院理工学研究科
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山田 宏之
愛媛大 大学院理工学研究科
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山田 宏之
愛媛大学工学部
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松永 敏幸
愛媛大学工学部情報工学科
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井上 健
神戸商船大学情報システム工学講座
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手塚 慶一
大阪大学工学部
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松下 芳典
大阪大学工学部通信工学科
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樹下 行三
大阪大学大学院工学研究科応用物理専攻
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樹下 行三
大阪学院大学情報学部
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井上 健
神戸商船大学商船学部計測工学講座
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Saluja Kewal
Univ. Wisconsin‐madison Usa
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Kajihara S
Kyushu Inst. Technol. Iizuka‐shi Jpn
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栂岡 靖典
愛媛大学工学部情報工学科
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綾野 秀和
愛媛大学工学部情報工学科
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Keller Keith
ウィスコンシン大学マディソン校
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水本 涼
愛媛大学工学部情報工学科
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ボアテン クワメ
愛媛大学大学院理工学研究科
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ボアテン クワメ
愛媛大学 工学部 情報工学科
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干 湘秋
愛媛大学工学部
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小川 泰次郎
愛媛大学工学部情報工学科
著作論文
- 組合せ回路および順序回路に対する診断用テスト圧縮法(LSIシステムの実装・モジュール化・インタフェース技術, テスト技術)
- 順序回路に対するテスト系列中のドントケア値発見とテスト圧縮・消費電力削減への応用について(LSIシステムの実装・モジュール化・インタフェース技術, テスト実装, 一般)
- 順序回路に対するテスト系列中のドントケア値発見とテスト圧縮・消費電力削減への応用について
- 隣接信号線を考慮したオープン故障の一モデルとその故障診断(BISTと故障診断,VLSI設計とテスト及び一般)
- 検出/非検出情報に基づく複数故障モデルに対する故障診断法(故障診断, VLSI 設計とテスト及び一般)
- 検出/非検出情報に基づくオープン故障診断への誤り経路追跡法の適用(故障診断, VLSI 設計とテスト及び一般)
- 不確かなテスト集合の検出/非検出情報に基づくオープン故障の診断法(BIST と故障診断, VLSI 設計とテスト及び一般)
- 不確かなテスト集合の検出/非検出情報に基づくブリッジ故障の診断法(BIST と故障診断, VLSI 設計とテスト及び一般)
- 不確かなテスト集合によるブリッジ故障診断(テスト設計)(VLSIの設計/検証/テスト及び一般)(デザインガイア2004-VLSI設計の新しい大地を考える研究会)
- 不確かなテスト集合によるブリッジ故障診断(テスト設計)(VLSIの設計/検証/テスト及び一般)(デザインガイア2004-VLSI設計の新しい大地を考える研究会-)
- 不確かなテスト集合によるブリッジ故障診断(テスト設計)(VLSIの設計/検証/テスト及び一般)(デザインガイア2004-VLSI設計の新しい大地を考える研究会-)
- 不確かなテスト集合によるブリッジ故障診断(テスト設計)(VLSIの設計/検証/テスト及び一般)(デザインガイア2004-VLSI設計の新しい大地を考える研究会-)
- Pass/Fail情報を用いた単一ブリッジ故障の診断における診断テストと故障モデルの関係(VLSI設計とテスト)
- CMOS回路における短絡故障の一モデルとそのテスト生成法
- 組合せ回路における短絡故障のテストに対する一提案
- 組合せ回路および順序回路に対する診断用テスト圧縮法(LSIシステムの実装・モジュール化・インタフェース技術, テスト技術)
- 順序回路に対するテスト系列中のドントケア値発見とテスト圧縮・消費電力削減への応用について(LSIシステムの実装・モジュール化・インタフェース技術, テスト実装, 一般)
- モジュール間の整合性検査のための要求仕様記述の検証
- 組合せ回路におけるクリティカル経路の検出
- 組合せ回路におけるクリティカル経路の一検出法
- 分割した構造記述関数による組合せ回路の経路解析
- 遅延効果を用いた組合せ回路における冗長故障のテスト生成法
- 組合せ回路のタイミング解析におけるクリティカル経路の一検出法
- 組合せ回路のタイミング解析におけるクリティカル経路の一検出法
- 検出/非検出情報に基づくオープン故障の一診断法(ディペンダブルコンピューティング)
- テストの検出/非検出情報に基づくオープン故障の診断法(VLSI設計とテスト)
- 地域における大学の役割の捉え直しに伴う地域IXの構想について(一般、インターネット制度論)
- 論理回路に対するテスト実行時間削減法
- BIST環境における不確かなテスト集合による単一縮退故障の一診断法(診断, LSIのテスト・診断技術論文)
- 不確かなテスト集合による多重縮退故障の診断(テスト設計)(VLSIの設計/検証/テスト及び一般)(デザインガイア2004-VLSI設計の新しい大地を考える研究会)
- 不確かなテスト集合による多重縮退故障の診断(テスト設計)(VLSIの設計/検証/テスト及び一般)(デザインガイア2004-VLSI設計の新しい大地を考える研究会-)
- 不確かなテスト集合による多重縮退故障の診断(テスト設計)(VLSIの設計/検証/テスト及び一般)(デザインガイア2004-VLSI設計の新しい大地を考える研究会-)
- 不確かなテスト集合による多重縮退故障の診断(テスト設計)(VLSIの設計/検証/テスト及び一般)(デザインガイア2004-VLSI設計の新しい大地を考える研究会-)
- 不確かな診断テスト集合による単一/多重縮退故障の診断法(VLSI設計とテスト)
- 組合せ回路のコンパイル型遅延故障シミュレータについて
- 信号伝搬時間を利用した組合せ回路の多重縮退故障に対する一診断法
- 電子ビームテスタを用いた活性化入力対による組合せ回路の多重故障診断
- 活性化入力系列を用いた順序回路の故障診断に関する一考察
- 活性化入力対を用いた組合せ回路の多重縮退故障の診断に関する一考察
- 単一活性化経路に基づく組合せ回路の多重縮退故障の診断法に関する一考察
- 不確かなテスト集合をもつBISTの故障診断法
- 順序回路のクロストークによる遅延故障に対する目標故障の一判別法
- FTS2000-24 縮退故障のテスト集合に基づくパス遅延故障の一テスト生成法
- ゲート遅延故障シミュレーションを用いた単一ゲート遅延故障の一診断法 (テストと設計検証論文特集)
- 改良Booth法に基づく乗算回路のC-テスタブル設計について
- 改良Booth法に基づく乗算回路のC-テスタブル設計について
- 組合せ回路の微小なゲート遅延故障に対するテストとその生成法
- 組合せ回路の微小なゲート遅延故障に対するテスト生成
- 組合せ回路のゲート遅延故障に対する高分解能テストの生成
- 組合せ回路のタイミング解析におけるクリティカル経路問題について
- 順序回路の前方テスト生成に対する一手法
- 順序回路のブリッジ故障に対するIDDQテストのための静的なテスト系列圧縮法 (テストと設計検証論文特集)
- リセット機能を持つ順序回路に対するテスト系列圧縮法