組合せ回路におけるクリティカル経路の一検出法
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概要
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近年,LSIの高速化に伴いタイミング検証が重要になっており,その中の一つに回路の入力から出力に至る遅延の最も大きい経路(クリティカル経路)の検出がある.一般に,回路の構造的に最も長い経路がクリティカル経路であるとは限らないので,活性化可能な最も長い経路をクリティカル経路として検出しなければならない.本稿では,経路の動的活性化性に基づいて,回路のクリティカル経路を検出する一手法を提案する.提案する手法では,64時刻間の信号変化を扱うことができるデータ構造を導入し,信号線の最も遅い信号変化の時刻のみを基にする動的活性化性の判定を行う方法より正確にクリティカル経路を検出することができる.本手法は,経路のリストを必要としないので、大規模回路にも適用できる.
- 社団法人電子情報通信学会の論文
- 1995-03-27
著者
-
高橋 寛
愛媛大学大学院理工学研究科
-
高橋 寛
愛媛大学工学部情報工学科
-
高松 雄三
愛媛大学工学部情報工学科
-
于 湘秋
愛媛大学工学部情報工学科
-
高松 雄三
愛媛大学工学部
-
干 湘秋
愛媛大学工学部情報工学科
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