機能等価性情報を用いたRTL-GLパスマッピングの一手法(高位合成及び検証,信号処理,LSI,及び一般)
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概要
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論理合成やテストの際,回路のフォールスパスの情報を用いることで論理合成時間の短縮,回路面積の削減,テスト生成時間の短縮,過剰テストの緩和ができるといった利点がある.ゲートレベルでのフォールスパスの探索はパス数が膨大な大規模回路に対しては困難であるため,より高位の設計情報(RTLや高位合成情報)を利用した手法が提案されている.これまでに提案されている手法では,モジュール境界保存型論理合成を用いることでRTLパスとゲートレベルパスの対応を保証しているが,本稿ではモジュールの境界を保存しない論理合成を行う場合でもRTLパスとゲートレベルパスの対応関係を得る方法を提案する.具体的には,RTLパスを構成するビットごとのRTL信号線とゲートレベルパス上の信号線との対応をとり,その情報を利用することでパスの対応をとる.さらに,提案手法の実装方法について述べ,実験結果として,対応をとることができたRTLパスの割合であるパスマッピング率と誤判定率を示す.
- 社団法人電子情報通信学会の論文
- 2008-06-20
著者
-
藤原 秀雄
奈良先端科学技術大学院大学 情報科学研究科
-
大竹 哲史
奈良先端科学技術大学院大学 情報科学研究科:科学技術振興機構 Crest
-
大竹 哲史
奈良先端科学技術大学院大学情報科学研究科
-
岩田 大志
奈良先端科学技術大学院大学 情報科学研究科:科学技術振興機構 Crest
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