レジスタ転送レベルデータパスの単一制御並行可検査性に基づく組込み自己テストについて
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概要
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本稿では,レジスタ転送レベルデータパスの単一制御並行可検査性を提案し,この可検査性に基づく組込み自己テスト方式を提案する.単一制御並行可検査性は,複数の組合せ回路要素を同時にテストできるように,単一制御可検査性を拡張したものである.さらに,与えられたデータパスを単一制御並行可検査にするためのテスト容易化設計法も提案し,ベンチマーク回路を用いて,提案手法の評価を行う.この手法では,組合せ回路要素を1つずつテストする単一制御可検査性に比べて,テスト実行時間を削減することができる.
- 社団法人電子情報通信学会の論文
- 2001-04-06
著者
-
増澤 利光
大阪大学大学院情報科学研究科
-
藤原 秀雄
奈良先端科学技術大学院大学 情報科学研究科
-
山口 賢一
奈良先端科学技術大学院大学情報科学研究科;(現)奈良工業高等専門学校情報工学科
-
和田 弘樹
株式会社日立製作所中央研究所システムlsi研究部
-
和田 弘樹
奈良先端科学技術大学院大学 情報科学研究科
-
山口 賢一
奈良先端科学技術大学院大学情報科学研究科
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