状態並列に基づく順序回路テスト生成の並列処理について
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概要
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本論文では、マルチプロセッサシステムによる順序回路テスト生成の並列処理手法について考察する。まず、テスト生成困難な故障を検出するために、テスト生成時の状態遷移に着目し、テスト生成容易な故障に対するテスト生成過程に出現した回路の状態をテスト生成困難な故障のテスト初期状態としてテスト生成を行う手法を提案する。さらに、その手法の高速化を図るための状態並列法を提案する。最後に、ワークステーションネットワーク上において、ISCAS'89ベンチマーク回路による実験結果を示す。
- 1997-02-13
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