ホールド機能を考慮した順序回路の部分スキャン設計法
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概要
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本論文では, ホールド機能をもつレジスタ(ホールドレジスタ)を考慮した順序回路の部分スキャン設計法を提案する.無閉路順序回路のテスト生成は, すべての極大展開モデルに対し, 組合せ回路用のテスト生成アルゴリズムでテスト生成を行えば十分である.そこで, 極大展開モデルが唯一となる(最大展開モデルをもつ)ような順序回路のクラスを提案する.更に, 一般の順序回路から最大展開モデルが存在する無閉路順序回路に変更する部分スキャン設計法について, スキャンハードウェアオーバヘッドを最小にするスキャンレジスタ選択問題を定式化し, その問題を解くヒューリスティックアルゴリズムを提案する.これにより, 部分スキャン設計におけるスキャンハードウェアオーバヘッドは, ホールドレジスタを含まない順序回路に比べ小さく実現可能である.
- 社団法人電子情報通信学会の論文
- 2000-09-25
著者
-
井上 智生
広島市立大学情報科学部
-
藤原 秀雄
奈良先端科学技術大学院大学 情報科学研究科
-
井上 智生
広島市立大学大学院情報科学研究科
-
Das K
ジャダプール大学計算機科学・工学科
-
佐野 ちいほ
奈良先端科学技術大学院大学情報科学研究科
-
三原 隆宏
三菱電機コントロールソフトウェア株式会社
-
K.DAS Debesh
ジャダプール大学計算機科学・工学科
-
Das Debesh
ジャダプール大学計算機科学・工学科
-
井上 智生
広島市立大学大学院 情報科学研究科
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