300MHz並列ベクトルパイプライン画像処理プロセッサ
スポンサーリンク
概要
- 論文の詳細を見る
300MHzで動作する動画像信号処理プロセッサ(VSP3)を開発した。VSP3はCCITT H.261準拠のfull-CIF画像を、毎秒30フレームの速度で符号化処理する性能を持つ。この性能を達成するために、ベクトルパイプライン処理可能なアーキテクチャ、符号化アルゴリズムの実行に適した構成の演算ユニット、300MHz動作のALU、積和演算器、アクセス3nsのメモリ、300MHzのクロック信号を発生するPLL形周波数逓倍回路、メモリやバスのアクセスを高速化するBiNMOSパストランジスタ回路などを開発した。0.5μmBiCMOS3層アルミ配線プロセスを用い、16.5mm×17.0mmのチップサイズに127万トランジスタを集積した。
- 社団法人電子情報通信学会の論文
- 1993-04-23
著者
-
後藤 順一
日本電気株式会社
-
野村 昌弘
Necエレクトロニクス(株)lsi基礎開発研究所
-
榎本 忠儀
中央大学理工学部
-
山田 八郎
NECマイクロエレクトロニクス研究所
-
木村 亨
Nec
-
木村 亨
Nec マイクロエレクトロニクス研究所システムulsi研究部
-
井上 俊明
川崎市公害研究所
-
山品 正勝
Necシリコンシステム研究所 システムulsi研究部
-
山品 正勝
Necマイクロエレクトロニクス研究所 システムulsi研究部
-
山品 正勝
NEC Corporation
-
本村 真人
NECシリコンシステム研究所
-
熊谷 浩一
Nec Ulsiデバイス開発研究所
-
井上 俊明
NEC
-
井上 俊明
NECマイクロエレクトロニクス研究所
-
本村 真人
NECマイクロエレクトロニクス研究所
-
野村 昌弘
NECマイクロエレクトロニクス研究所
-
鈴木 一正
NECマイクロエレクトロニクス研究所
-
堀内 忠彦
NECマイクロエレクトロニクス研究所システムULSI研究所
-
小関 陽一
NEC
-
厚母 敬生
NEC光エレクトロニクス研究所
-
井上 俊明
NECシリコンシステム研究所
-
野村 昌弘
STARC
-
鈴木 一正
Nec
-
後藤 順一
NECマイクロエレクトロニクス研究所システムULSI研究部
-
小関 陽一
NECマイクロエレクトロニクス研究所システムULSI研究部
-
木村 亨
NECマイクロエレクトロニクス研究所システムULSI研究部
-
厚母 敬生
NECマイクロエレクトロニクス研究所システムULSI研究部
-
濱武 伸寿
NEC ULSIデバイス開発研究所デバイス開発部
-
榎本 忠儀
NEC ULSIデバイス開発研究所
-
山田 八郎
中央大学理工学部情報工学科
-
高田 正日出
NEC マイクロエレクトロニクス研究所
-
厚母 敬生
Nec マイクロエレクトロニクス研究所
-
高田 正日出
Nec
-
濱武 伸寿
Nec Ulsiデバイス開発研究所
関連論文
- 1チップMPEG-2 MP@MLビデオ符号化LSIにおけるクロック制御方式
- ブロックマッチングの停止条件を適応的に設定する高速動きベクトル検出アルゴリズムの開発(無線/画像処理,システムオンシリコン設計技術並びにこれを活用したVLSI)
- ネガティブエッジ型CMOSディレイフリップフロップの設計とその性能
- フラッシュ連想メモリ(Flash CAM)検索センスアンプの開発
- 1Mb 2Tr/bitフラッシュ連想メモリ(Flash CAM)
- 1Mbit 2Tr/bitフラッシュ内容アドレスメモリ : Flash CAM
- ビデオシグナルプロセッサ (VSL) ULSI の高性能化 ( マイクロプロセッサ 4. 高速化動向 4-1)
- 柔軟かつ高速な再構成を実現した動的再構成ロジックLSI
- C-12-34 動的再構成ロジックLSIの開発(2)
- C-12-33 動的再構成ロジックLSIの開発(1)
- 1チップMPEG-2 MP@MLビデオ符号化LSIの開発
- A-100 SIMD方式によるデータフロー制御の一検討(A-4. ディジタル信号処理,一般講演)
- 実時間動画像処理プロセッサLSI : 電子装置 : 画像表示
- 3.ディジタル集積回路における素子ばらつきの影響と対策(CMOSデバイスの微細化に伴う特性ばらつきの増大とその対策)
- 高性能マイクロプロセッサを実現するクロック分配技術
- 500MHz 32ワード x32ビット 3ポートレジスタファイル
- 500MHz 0.4μm CMOS 32ワード×32ビット3ポートレジスタファイル
- MOS電流モード(MCML)回路の消費電力特性の解析
- MOS電流モード回路を用いた適応型パイプライン技術(2)
- MOS電流モード回路を用いた適応型パイプライン技術(1)
- MOS電流モード回路を用いてデバイスばらつき、動作環境変化クロックスキューを補償するアダプティブパイプライン技術
- 30ビットパイプラインカウンタ回路
- 1.8GHz 1.6V MOS電流モード(MCML)フリップフロップ回路
- 500HMz,1.5%ジッタPLLクロック発生回路
- 500MHz32ビット0.4μm CMOS RISCマイクロプロセッサ
- ダイナミック協働型ドライブ技術を用いた双方向バスリピータの自動方向制御方式(VLSI回路,デバイス技術(高速,低電圧,低電力))
- DVFSに向けた高速動きベクトル検出アルゴリズムとこれを適用した低電力動きベクトル検出プロセッサの開発(マルチコア,プロセッサ,VLSI回路,デバイス技術(高速,低電圧,低消費電力))
- DVFSに向けた高速動きベクトル検出アルゴリズムとこれを適用した低電力動きベクトル検出プロセッサの開発(マルチコア,プロセッサ, VLSI回路,デバイス技術(高速,低電圧,低消費電力))
- ダイナミック協働型ドライブ技術を用いた双方向バスリピータの自動方向制御方式(VLSI回路,デバイス技術(高速,低電圧,低電力))
- ゲートリークの救世主、それはHigh-k!(VLSI回路, デバイス技術(高速・低電圧・低消費電力))
- ゲートリークの救世主、それはHigh-k!(VLSI回路, デバイス技術(高速・低電圧・低消費電力))
- C-12-9 8-bit 90-nm CMOS桁上げ先見加算回路の低リーク電流化と高速化(C-12. 集積回路B(ディジタル), エレクトロニクス2)
- DVFSのための電圧ステップ幅制御およびリファレンス電圧制御を用いた高速電源電圧制御方式(学生・若手研究会)
- C-12-13 先端CMOSプロセス向けSRAM開発におけるSRAMセル諸特性の効率的ばらつき評価手法(C-12.集積回路,一般セッション)
- CMOS回路の低電圧化はどうすすめるべきか(VLSI回路,デバイス技術(高速,低電圧,低電力))
- CMOS回路の低電圧化はどうすすめるべきか(VLSI回路,デバイス技術(高速,低電圧,低電力))
- 柔軟かつ高速な再構成を実現した動的再構成ロジックLSI
- 柔軟かつ高速な再構成を実現した動的再構成ロジックLSI
- キャッシュープロセッサカプッリング : 高速/高バンド幅オンチップデータキャッシュ設計法の一提案
- 300MHz 16ビット 0.5μm BiCMOS DSP コアLSI
- 300MHz並列ベクトルパイプライン画像処理プロセッサ(マイクロ・プロセッサ,ニューラルネットワーク)
- 300MHz並列ベクトルパイプライン画像処理プロセッサ
- ビデオ信号処理プロセッサ用50〜350MHzロックレンジプログラマブル・クロック発生回路
- Dynamic Voltage & Frequency scaling : ディープサブ100-nmを救えるか!(電源制御,パワーゲーティング,VLSI回路,デバイス技術(高速,低電圧,低消費電力))
- 消費エネルギー最小化のための最適電源電圧決定回路(電源制御,パワーゲーティング,VLSI回路,デバイス技術(高速,低電圧,低消費電力))
- Dynamic Voltage & Frequency Scaling : ディープサブ100-nmを救えるか!(電源制御,パワーゲーティング, VLSI回路,デバイス技術(高速,低電圧,低消費電力))
- 消費エネルギー最小化のための最適電源電圧決定回路(電源制御,パワーゲーティング, VLSI回路,デバイス技術(高速,低電圧,低消費電力))
- 次世代SRAMのために再定義した書き込みマージン(新メモリ技術とシステムLSI)
- 動作時および待機時における電源電圧およびしきい電圧の制御による消費電力最小化のためのモニタリング方式(VLSI回路, デバイス技術(高速・低電圧・低消費電力))
- 動作時および待機時における電源電圧およびしきい電圧の制御による消費電力最小化のためのモニタリング方式(VLSI回路, デバイス技術(高速・低電圧・低消費電力))
- 低電圧時の安定高速動作を実現するノイズマージンフリーSRAM技術(新メモリ技術, メモリ応用技術, 一般, ISSCC特集1 SRAM)
- 低電圧時の安定高速動作を実現するノイズマージンフリーSRAM技術
- サブ100nm世代におけるGHz動作SRAMマクロのためのセンス方式(新メモリ,メモリ応用技術,一般)
- C-12-38 マルチメディアRISCプロセッサに搭載したRambus DRAMコントローラの命令プリフェッチ機能と性能評価
- 中断法動きベクトル検出アルゴリズムを適用した動きベクトル検出アレイLSIの設計
- 中断法動きベクトル検出アルゴリズムを適用した動きベクトル検出アレイLSIの設計
- 中断法動きベクトル検出アルゴリズムを適用した動きベクトル検出アレイLSIの設計
- 中断法動きベクトル検出アルゴリズムの開発と動きベクトル検出アレイへの応用
- 1チップMPEG2エンコーダ用RISCプロセッサの設計とその低消費電力化
- 1チップMPEG2エンコーダ用RISCプロセッサの設計とその低消費電力化
- 1チップMPEG2エンコーダ用RISCプロセッサの設計とその低消費電力化
- 中断法動きベクトル検出の差分絶対値和アレイLSI
- 2段パイプライン構成の差分絶対値和アレイLSI
- 中断法動きベクトル検出アルゴリズムの改良
- 中断法動きベクトル検出アルゴリズム
- 1チップ低消費電力MPEG2動画像符号化器LSIの検討
- 1W 500MHz 24b GaAs RISCプロセッサの設計
- GaAs DCFL LSIの低消費電力化技術 : 動作時/待期時消費電力は電源電圧の3乗に比例
- GaAs DCFL LSIの低消費電力化技術 : 動作時/待期時消費電力は電源電圧の3乗に比例
- GaAs SRAMの低消費電力化技術とその効果
- GaAs DCFL回路の低消費電力化 : 動作時/待期時消費電力は電源電圧の3乗に比例
- サブ50nm時代の切り札SOI : SOIがBulkに勝てる技術はこれだ!(VLSI回路, デバイス技術(高速・低電圧・低消費電力))
- サブ50nm時代の切り札SOI : SOIがBulkに勝てる技術はこれだ!(VLSI回路, デバイス技術(高速・低電圧・低消費電力))
- SIMD演算器へのノルム計算命令組み込み手法の検討
- 機能メモリのアーキテクチャとその並列計算への応用 2. 集積回路技術からみた機能メモリの現状と展望
- ED2000-123 / SDM2000-105 / ICD2000-59 携帯情報端末(IMT-2000等)用MPEG4-LSI技術
- ED2000-123 / SDM2000-105 / ICD2000-59 携帯情報端末(IMT-2000等)用MPEG4-LSI技術
- Rambus DRAMを主記憶に採用したマルチメディア指向RISCプロセッサ
- マルチメディアプロセッサのRambus DRAMコントローラ
- C-12-44 画素データのMSBを用いた動きベクトル検出とCMOS差分絶対値和アレイの構成
- C-12-19 平方根・除算回路とその低消費電力化
- ソース電位制御発振器(S-VCO)を用いたCMOS PLLクロックパルス発生器(アナログ・デジアナ・センサ, 通信用LSI)
- ソース電位制御発振器(S-VCO)を用いたCMOS PLLクロックパルス発生器
- C-12-27 発振周波数幅を広げた段数・ソース電圧可変型VCO
- バックゲートバイアス制御発振器(BG-VCO)を用いたCMOS PLLクロックパルス発生器
- ソース電位で制御するVCO(SVCO)とそれを用いたPLLの設計
- ソース電位で制御するVCO(SVCO)とそれを用いたPLLの設計
- ソース電位で制御するVCO(SVCO)とそれを用いたPLLの設計
- MPEG2動画像符号化器用RISCプロセッサアーキテクチャ
- 4kbit 74mW 1.85nsec GaAs SRAM
- ブロックマッチングの停止条件を適応的に設定する高速動きベクトル検出アルゴリズムの開発(無線/画像処理,システムオンシリコン設計技術並びにこれを活用したVLSI)
- D-11-29 動きの遅い動画像に対するマルチステップ中断法とその探索領域の最適化
- CMOS差分絶対値回路
- MPEG2対応CMOSDCT/IDCT専用LSI
- MPEG2用130mW2次元DCT/IDCTプロセッサ
- 70mW MPEG2用可変長符号化器(VLC)
- 動きベクトル検出用CMOS差分絶対値和アレイ
- 低振幅低雑音入出力バッファ回路
- 高駆動能力階層短絡クロックツリー方式
- 高密度SRAMの微細化を可能とする階層セルアーキテクチャと多段階ワード線制御方式(SRAM,メモリ(DRAM,SRAM,フラッシュ,新規メモリ)技術)