A Practical Threshold Test Generation for Error Tolerant Application
スポンサーリンク
概要
- 論文の詳細を見る
Threshold testing, which is an LSI testing method based on the acceptability of faults, is effective in yield enhancement of LSIs and selective hardening for LSI systems. In this paper, we propose test generation models for threshold test generation. Using the proposed models, we can efficiently identify acceptable faults and generate test patterns for unacceptable faults with a general test generation algorithm, i.e., without a test generation algorithm specialized for threshold testing. Experimental results show that our approach is, in practice, effective.
- (社)電子情報通信学会の論文
- 2010-10-01
著者
-
ICHIHARA Hideyuki
Hiroshima City University
-
INOUE Tomoo
Hiroshima City University
-
市原 英行
広島市立大学大学院情報科学研究科
-
Yoshikawa Yuki
Hiroshima City University
-
Inoue Tomoo
Hiroshima City Univ. Hiroshima‐shi Jpn
-
SUTOH Kenta
Hiroshima City University
関連論文
- 高圧縮可能かつコンパクトなテスト生成について(テスト圧縮, LSIのテスト・診断技術論文)
- 部分スルー可検査性に基づく順序回路のテスト生成法(ディペンダブルコンピューティング)
- Design and Optimization of Transparency-Based TAM for SoC Test
- マルチメディアコアの展開機能を利用したテストデータ圧縮・展開(デザインガアイ2006-VLSI設計の新しい大地を考える研究会)
- マルチメディアコアの展開機能を利用したテストデータ圧縮・展開(VLSIのテストI,デザインガイア2006-VLSI設計の新しい大地を考える研究会)
- テスト圧縮・展開手法におけるバッファ付き展開器について(LSIシステムの実装・モジュール化・インタフェース技術, テスト実装, 一般)
- テスト展開器のオーバヘッド削減のためのテストベクトルの並べ替えについて(VLSI設計とテスト)
- ハフマン符号に基づくテスト実行のためのテスト圧縮について
- ハフマン符号を用いたテスト応答圧縮について
- 故障の許容性に基づく閾値テスト生成のための回路モデル(安全性及び一般)