再構成可能並列VLSIプロセッサと知能ロボット制御への応用
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概要
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自律的動作を目指す知能ロボットシステムにおいては,スループット向上のみならず,センサ信号入力から制御出力までの演算遅れ時間減少が重要な問題となる.このような知能ロボットシステムには,行列・ベクトル演算のための多くの積和演算が必要となる.本稿では,種々の多入力積和演算の遅れ時間を減少するとともに,多入力積和演算結果の転送を効率良く行うため,従来の多入力積和演算器の再構成の概念を拡張することにより,種々の行列・ベクトル演算器を再構成可能な並列VLSIアーキテクチャを提案している.0.8μmCMOS設計ルールに基づく性能評価の結果,ディジタル信号処理プロセッサを用いた並列プロセッサによる処理と比較して演算遅れ時間を約1, 4に減少できることを明らかにしている.
- 社団法人電子情報通信学会の論文
- 1994-10-21
著者
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