冗長2進数系に基づく演算回路の速度とチップ面積
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概要
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In this paper, the arithmetic circuits based on the redundant binary number system are compared with ones based on the usual binary number system from the view points of operation speed and chip size. Following results are obtained, where N denotes the length of digits and the ratio shows the value of the redundant binary arithmetic circuits divided by that of the usual binary arithmetic circuits. (1) The ratio of chip size is about 4 times and is independent on the type of circuits and the value of N. (2) The ratio of operation speed of the adder is N times. (3) The ratio of operation speed of the multiplier is N times when pipelining operation is available, and is 3N/log_2 (N) times when pipelining operation is unavailable.
- 八戸工業大学の論文
- 2001-03-31
著者
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