剰余テーブルを循環する高速RSA暗号プロセッサのパイプラインアーキテクチャ
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概要
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In the preceding study,the author presented a design of a high-speed RSA encryption processor using redundant binary number arithmetic and table-look-up. The purpose of this study is to improve the encryption rate of the processor when the plaintext data is continuously input. This paper newly presents a pipelined architecture in which the table data is circulated over all pipeline units in order to make use of a single residue table for all these units. It is demonstrated that the encryption rate for continuous input data of the presented processor is approximately 2.4 times that of conventional processors.
- 八戸工業大学の論文
- 2005-02-28
著者
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