WSI 規模2次元 FFT プロセッサの冗長化設計
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概要
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本論文は, テレビ画像信号をリアルタイム処理可能な2次元 FFT プロセッサの実現を目標としている. 本プロセッサは多くのハードウェアを要し, 現段階では WSI 規模の集積度を必要とする. 本論文では冗長化手法(欠陥救済技術)の導入によって歩留りの低下を抑え, 2次元 FFT プロセッサを実現する方法について検討している. 本プロセッサは, バタフライ演算を時分割で繰り返し実行する構成をもつ. その繰返し制御回路の構成法と冗長化の方法が本研究の主要な課題となっている. 本論文では, 本回路の効率的な構成法と本回路特有の冗長化の方法を提案している. 冗長化設計を行った結果, 歩留り50%となる基準 LSI の約35倍の面積を有する2次元 FFT プロセッサが, 冗長化によるチップ面積の増加が9.3%で, かつ基準 LSI と同じ歩留りで構成できることがわかった.
- 1997-12-25
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