WSI規模高速FFTプロセッサの冗長化
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概要
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本論文は画像信号をリアルタイム処理可能なFFTプロセッサの実現を目的としている. このような高速FFTプロセッサは, すべての演算をハードウェアで実現する必要があり, WSI規模の集積度となる. 本論文では, このようなFFTプロセッサを実現するための冗長化の方法について検討している. 特に, バタフライ間の相互配線のチップ面積を重視した, 次のような冗長化の方法を示している. 〇!1非冗長なFFTプロセッサの設計段階において, 相互配線の占める面積をできるだけ縮小するようなシステム設計を提案している.〇!2相互配線自身の欠陥を救済できるような冗長化の方法を提案している. 〇!3歩留り計算において, 相互配線の面積の効果をすべて考慮に入れた計算式を導いている. 〇!4冗長化設計において, 冗長な配線の面積および切換スイッチの面積を含めた冗長なチップ面積の合計が最小となる条件を見出している. 冗長化設計を行った結果, 歩留り50%となる基準LSIの約120倍の面積を有するFFTプロセッサが, 冗長化による面積の増加が6%で, かつ基準LSIと同じ歩留りで構成できることがわかった.
- 社団法人電子情報通信学会の論文
- 1997-01-25
著者
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