知能ロボット制御用再構成可能並列ULSI/WSIプロセッサ
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概要
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本研究者らは、知能ロボット制御に必要な種々の演算に汎用的に使用でき、かつ、演算遅れ時間を最小にすることを目指した「再構成可能並列VLSIプロセッサ」を提案してきた。本稿では、このプロセッサをPEとして、数十〜100個のPEを単一のULSI/WSI上に集積する高集積プロセッサの構成法を検討している。そして、(1)集積した多数のPE間のデータ伝送を多重バスで行うこととし、その効率的な構成法を提案している。(2)ULSI/WSIの歩留り低下に対する対策として、欠陥救済構成を導入することとし、再構成可能並列アーキテクチャという特長を生かした欠陥救済システム構成を提案している。設計を行った結果、PE120個を搭載した高集積プロセッサが、欠陥救済構成の導入によるチップ面積の増加が34%で構成できることが明らかとなった。
- 社団法人電子情報通信学会の論文
- 1997-12-12
著者
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